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图5.8-1 由逻辑转换仪获得的真值表 2. 电路的实现及仿真结果 图5.8-2 表决器的仿真电路 5.9 模25计数器的设计 1. 模25计数器的设计方法 图5.9-1 74LS160的管脚示意图 表5.9-1 74LS160的管脚功能表 因为是2位十进制计数器，所以电路设计中必须用两片74LS160，一片(74LS160A)控制低位，一片(74LS160B)控制高位。计数器的输入设为1 Hz脉冲信号，接到74LS160A的CLK端。高位的计数应由低位的进位决定，因此，高位的74LS160B的CLK端应由74LS160A的RCO端控制，但是由于74LS160的CLK脉冲为上升沿触发，所以级联时低位的进位信号通过一反相器接到高位的CLK端，否则计数器会在低位到8后即进位。 因为是模25计数器，即当计数到24后就清零，所以必须在计数到25时分别给两片74LS160的CLR端送去清零信号。由于25的8421码表示为，因此应将74LS160B的QB和74LS160A的QA、QC三个管脚通过一与非门接两片74LS160的CLR端。这就是异步清零法。 或者采用同步置数的方法。因为是模25计数器，即当计数到24后就置数，所以必须在计数到24时分别给两片74LS160的LOAD端送去置数信号。由于24的8421码表