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/forum.php?mod=viewthreadtid=3982551
第一次把四层板画完,发去做了,现在有点无聊。
以前参加电子竞赛的时候,都是画单层板,这次毕业课题忽然要画四层,开始的时候以为没什么,但是发现这个过程中还是遇到很多问题,现在整理一下,仅供没有画过四层板的参考,高手们请多拍砖,下面就开始了。
一.原理图
一般用四层板的原理图还是分模块画好,其实和画在一幅里面是一样的,同样名字的网络也还
是互相连接的,都的时候需要放置输入输出的接口,我个人认为放不放都行的。
我采用的是自底向上的方法画的,就是说先把各个模块画好,然后再综合进行ERC
首先画好各个模块,然后再新建一个TOP.Sch,在TOP.Sch里面放置SHEETSYMBOL(在placewire正下方),如下图设置,FileName即你要代表的原理图单元的文件,
(原文件名:sheetsymbol.jpg)
IO.Sch即输入输出的模块,name可以随便取。
下面的过程要特别注意,在综合时要编辑各个原理图模块的属性,以第一个AD.Sch为例,
,3J
,3J了
r
汉
G口
[ oSheetOptions 0『ganization
[ o
『g11niz11tion
Add『ess
Sheet
DocumentTitlel—No.No,
Document
Title
l—
No.
OKCancel jHelpTota
OK
Cancel j
Help
(原文件名:org.jpg)
在空白处右击,选择DocumenOption,设置sheet为0,total为总的原理图的单元,按照同样的方法,依次设置所有的模块,设置好后,自动出现下图,所有的模块都在TOP.Sch下面了。
AD
臣丿+m|三日日
_J
l门iW厂l 1-+-
C/BEO#
iCfBEl#C/BE2#C/BE3#IDSEL#PARCLKFRAME#
i
』DEVSEL#IRDY#TRDY#LOCKSTOP#PER邸
』
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| LAD[l5.OJ
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IIIIIII
(原文件名:TOP.jpg)
白浣TOP,Sch
;二0l
;二0
『',迁)connector.Sch
:.,如.=D.-DA.Sch
飞节IO.Sch
:产:..,.茫 pci9052,
:产
扩.心.]power.Sch
!..周.fpga1,Sch
..茫lfpga2,Sch
(原文件名:总的sch.jpg)
当完成原理图以后,要进行ERC检查,这时候要设SheetstoNetlist要置成ActiveProject.
lI i I l ! I I t I t ` , t, +
l
SetupEle亡tIIEaIRu|巳Check ty
Setup IRuleM的ixI
...-ERCOptions
PMultiplenetnames(]
PUnconnectednetI
P Unconnectedpowerol
17Duplicatesheetnur
17Duplicatecomponentdesi
PBus labelformat?P FloatinginputJJ
厂Suppresswarr
,--Options
p-C『eatereport1
P Adder『O『ma1
丿,厂Descendintosheet
丿
| SheetstoNetlist
IActiveproject 且
[ NetIdentifierScope INetLabelsandPortsGlobal 斗
OK l Cancel Help
II
(原文件名:erv.jpg)
原理图就算搞好了,下面搞PCB。
和单层板生成PCB一样。画四层板,首先要把模拟和数字的分清,分好区,这样在割地和分割电源时就会省很多力,另外同样电源的尽量靠在一起。先有个大致的想法后,就可以进行布线了,首先布信号层(一般放在表面),至于规则就不说了。下面详细的说一下分割内电层。下面是我分割的内电层,电源有
+12AV,-12AV,
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