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数字电路基础课件.ppt 451页

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例 输出方程: 输出与输入有关,为米利型时序电路。 同步时序电路,时钟方程省去。 驱动方程: 1 写方程式 2 求状态方程 T触发器的特性方程: 将各触发器的驱动方程代入,即得电路的状态方程: 3 计算、列状态表 4 5 电路功能 由状态图可以看出,当输入X =0时,在时钟脉冲CP的作用下,电路的4个状态按递增规律循环变化,即: 00→01→10→11→00→… 当X=1时,在时钟脉冲CP的作用下,电路的4个状态按递减规律循环变化,即: 00→11→10→01→00→… 可见,该电路既具有递增计数功能,又具有递减计数功能,是一个2位二进制同步可逆计数器。 画状态图时序图 与输入主从JK触发器的逻辑符号 主从JK触发器功能完善,并且输入信号J、K之间没有约束。但主从JK触发器还存在着一次变化问题,即主从JK触发器中的主触发器,在CP=1期间其状态能且只能变化一次,这种变化可以是J、K变化引起,也可以是干扰脉冲引起,因此其抗干扰能力尚需进一步提高。 边沿触发器 1、边沿D触发器 工作原理 (1)CP=0时,门G7、G8被封锁,门G3、G4打开,从触发器的状态取决于主触发器Q=Qm、Q=Qm,输入信号D不起作用。 (2)CP=1时,门G7、G8打开,门G3、G4被封锁,从触发器状态不变,主触发器的状态跟随输入信号D的变化而变化,即在CP=1期间始终都有Qm=D。 下降沿时刻有效 (3)CP下降沿到来时,封锁门G7、G8,打开门G3、G4,主触发器锁存CP下降时刻D的值,即Qm=D,随后将该值送入从触发器,使Q=D、Q=D。 (4)CP下降沿过后,主触发器锁存的CP下降沿时刻D的值被保存下来,而从触发器的状态也将保持不变。 综上所述,边沿D触发器的特性方程为: 边沿D触发器没有一次变化问题。 逻辑符号 集成边沿D触发器 注意:CC4013的异步输入端RD和SD为高电平有效。 CP上升沿触发 2、边沿JK触发器 CP下降沿时刻有效 边沿JK触发器的逻辑符号 边沿JK触发器的特点 ①边沿触发,无一次变化问题。 ②功能齐全,使用方便灵活。 ③抗干扰能力极强,工作速度很高。 集成边沿JK触发器 ①74LS112为CP下降沿触发。 ②CC4027为CP上升沿触发,且其异步输入端RD和SD为高电平有效。 注意 不同类型触发器之间的转换 转换步骤: (1)写出已有触发器和待求触发器的特性方程。 (2)变换待求触发器的特性方程,使之形式与已有触发器的特性方程一致。 (3)比较已有和待求触发器的特性方程,根据两个方程相等的原则求出转换逻辑。 (4)根据转换逻辑画出逻辑电路图。 转换方法: 利用令已有触发器和待求触发器的特性方程相等的原则,求出转换逻辑。 1、将JK触发器转换为RS、D、T和T'触发器 JK触发器→RS触发器 RS触发器特性方程 变换RS触发器的特性方程,使之形式与JK触发器的特性方程一致: 比较,得: 电路图 JK触发器→D触发器 写出D触发器的特性方程,并进行变换,使之形式与JK触发器的特性方程一致: 与JK触发器的特性方程比较,得: 电路图 JK触发器→T触发器 在数字电路中,凡在CP时钟脉冲控制下,根据输入信号T取值的不同,具有保持和翻转功能的电路,即当T=0时能保持状态不变,T=1时一定翻转的电路,都称为T触发器。 特性表 逻辑符号 T触发器特性方程: 与JK触发器的特性方程比较,得: 电路图 状态图 时序图 JK触发器→T'触发器 在数字电路中,凡每来一个时钟脉冲就翻转一次的电路,都称为T'触发器。 特性表 逻辑符号 T '触发器特性方程: 与JK触发器的特性方程比较,得: 电路图 变换T'触发器的特性方程: 状态图 时序图 2、将D触发器转换为JK、T和T'触发器 D触发器→JK触发器 D触发器→T触发器 D触发器→T'触发器 本节小结:   触发器是数字电路的极其重要的基本单元。触发器有两个稳定状态,在外界信号作用下,可以从一个稳态转变为另一个稳态;无外界信号作用时状态保持不变。因此,触发器可以作为二进制存储单元使用。   触发器的逻辑功能可以用真值表、卡诺图、特性方程、状态图和波形图等5种方式来描述。触发器的特性方程是表示其逻辑功能的重要逻辑函数,在分析和设计时序电路时常用来作为判断电路状态转换的依据。   各种不同逻辑功能的触发器的特性方程为: RS触发器:Qn+1=S+RQn,其约束条件为:RS=0 JK触发器: Qn+1=JQn+KQn D触发器: Qn+1=D T触发器: Qn+1=TQn+TQn T'触发器: Qn+1=Qn   同一种功能的触发器,可以用不同的电路结构形式来实现;反过来,同一种电路结构形式,可以构成具有不同功能的各种类型触发器。

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