电子科大—数电—数字逻辑设计第五章.pptVIP

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2017-03-19 发布于四川
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电子科大—数电—数字逻辑设计第五章.ppt

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第5章组合逻辑设计实践文档标准和电路定时常用的中规模组合逻辑器件内容回顾译码器编码器三态器件多路复用器奇偶校验器比较器内容回顾译码器编码器三态器件多路复用器奇偶校验器比较器内容回顾译码器编码器三态器件多路复用器奇偶校验器比较器 5.10 加法器 5.10 加法器串行进位加法器迭代电路（iterative circuit）并行进位加法器并行进位加法器 MSI算术逻辑单元第6章组合电路设计实例桶式移位器简单浮点编码器双优先级编码器级联比较器关模比较器桶式移位器具有n个数据输入和n个数据输出控制输入：指定输入输出之间如何移动数据（移位方向、移位类型、移动的位数）设计一个简单16位桶式移位器（向左移位）方案一：利用74x151 方案一：利用74x151 方案二：利用74x157 浮点编码器双优先级编码器关模比较器输入：两个8位无符号二进制整数 X 和 Y 一个控制信号 M 输出：8位无符号二进制整数 Z 逻辑功能：M = 1，Z = min(X,Y) M = 0，Z = max(X,Y) * * 数字逻辑设计及应用 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. 标准MSI多路复用器 74x151、 74x153、74x157 扩展多路复用器利用多路复用器实现逻辑函数多路分配器 —— 利用带使能端的译码器使能端作为数据输入端 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. 奇校验：输入有奇数个1，输出为1 偶校验：输入有偶数个1，输出为1 利用异或运算实现 9位奇偶发生器74x280 奇偶校验的应用 —— 检测代码在传输和存储过程中是否出现差错。 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. 一位等值比较器（异或 / 同或）多位等值比较器每一位都相等一位数值比较器等值比较器并行比较串行比较数值比较器 A=B：A⊙B AB：A·B’ AB：A’·B 多位数值比较器 4位比较器74x85 8位比较器74x682 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. 半加器（half adder）和全加器（full adder） 0 0 0 0 0 1 0 1 1 0 0 1 1 1 1 0 A B S CO 半加器真值表相加的和：S = A’·B + A·B’ = A ? B 向高位的进位：CO = A·B 0 0 0 0 0 0 0 1 0 1 0 1 0 0 1 0 1 1 1 0 1 0 0 0 1 1 0 1 1 0 1 1 0 1 0 1 1 1 1 1 CI X Y S CO 全加器真值表 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. S CO X Y CI S = X ? Y ? CI X·Y 半加器（half adder）和全加器（full adder） 0 0 1 0 0 1 1 1 CI XY 00 01 11 10 0 1 CO X·CI CO = + + Y·CI = X·Y + (X+Y)·CI