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2017-06-23 发布于河南
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EDA技术-第三章

3.1 多路选择器的Verilog HDL描述 3.2 触发器的Verilog HDL描述 3.1 多路选择器的Verilog HDL描述 3.2 触发器的Verilog HDL描述例：2选1多路选择器的Verilog HDL描述 a 0 y 电路功能 b 1 实现 s 例：2选1多路选择器的Verilog HDL描述 ◦ 采用已有的数字电路相关知识如何进行设计？真值表 a b s Y a 0 0 0 0 0 y 0 1 0 0 b 1 1 0 0 1 1 1 0 1 s 0 0 1 0 0 1 1 1 1 0 1 0 1 1 1 1 例：2选1多路选择器的Verilog HDL描述 ◦ 采用已有的数字电路相关知识如何进行设计？卡诺图 ab 00 01 11 10 s a 0 0 0 0 1 1 y 1 0 1 1 0 b 1 逻辑表达式： y=as+bs s a s y b 例：2选1多路选择器的Verilog HDL描述 ◦ 采用Verilog语言描述2选1多路选择器？ ◦ 采用结构级描述 module mux2(a, b, s, y); input a, b, s; output y;