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CC2530介绍 CC2530芯片介绍 RF/LAYOUT –适应 2.4-GHz IEEE 802.15.4 的 RF 收发 器 –极高的接收灵敏度和抗干扰性能 –可编程的输出功率高达 4.5 dBm –只需极少的外接元件 –只需一个晶振，即可满足网状网络系统 需要 –6-mm × 6-mm 的 QFN40 封装 低功耗 –主动模式 RX（CPU 空闲）：24 mA –主动模式 TX 在 1dBm（CPU 空闲）：29 mA –供电模式 1（4 μs 唤醒）：0.2 mA –供电模式 2（睡眠定时器运行）：1 μA –供电模式 3（外部中断）：0.4 μA –宽电源电压范围（2 V–3.6 V） Direct Memory Acess 不通过CPU而在DMA控制器的控制下，高速地在I/O设备和存储器之间交换数据。 CC2530 外设 电源管理 RESET I/O DMA T1(16位) T2(MAC) T3/T4 串口 两种工作方式 UART SPI (可主可从) 波特率从2400到230400可设 可以产生中断 可以触发DMA,用于传输批量数据 端口的位置可选 芯片最小系统接法 CC2530典型应用电路 * 内核 –优良的性能和具有代码预取功能的低功 耗 8051 微控制器内核 –32-、64-或 128-KB 的系统内可编程闪存 –8-KB RAM，具备在各种供电方式下的数 据保持能力 –支持硬件调试 引脚名称 引脚 引脚类型 描述 AVDD1 28 电源（模拟） 2-3.6V模拟电源连接，为模拟电路供电 AVDD2 27 电源（模拟） 2-3.6V模拟电源连接，为模拟电路供电 AVDD3 24 电源（模拟） 2-3.6V模拟电源连接 AVDD4 29 电源（模拟） 2-3.6V模拟电源连接 AVDD5 21 电源（模拟） 2-3.6V模拟电源连接 AVDD6 31 电源（模拟） 2-3.6V模拟电源连接 DCOUPL 40 ?电源（数字） 1.8数字电源去耦。不使用外部电路供应 DVDD1 39 电源（数字） 2-3.6V数字电源连接，为引脚供电 DVDD2 10 电源（数字） 2-3.6V数字电源连接，为引脚供电 GND - 接地 接地面 GND 1，2，3，4 未使用引脚 连接到GND P2_3 33 数字I/O 端口2.3/32.768kHz XOSC P2_4 32 数字I/O 端口2.4/32.768kHz XOSC RBIAS 30 模拟I/O 参考电流的外部精密偏置电阻 RESET_N 20 数字输入 复位，活动到低电平 RF_N 26 RF I/O 在RX 期间向LNA（低噪声放大器）输入正向射频信号；在TX 期间接收来自PA 的输入正向射频信号 RF_P 25 RF I/O 在RX 期间向LNA 输入负向射频信号；在TX 期间接收来自PA 的输入负向射频信号 XOSC_Q1 22 模拟I/O 32-MHz晶振引脚1或外部时钟输入 XOSC_Q2 23 模拟I/O 32-MHz晶振引脚2 P0，P1，P2 P0，P1全部P2_0~P2_2 数字I/O 对应引脚号 CC2530引脚描述 功能框图 什么是DMA？ Sleep Timer ADC Random AES WDT UART Voltage Regulators CC2530芯片内部结构 CC2530需要极少的外部连接元件，同时有很多典型电路，其模块大致可以分为三类： 1、 CPU和内存相关模块 2、外设，时钟和电源管理相关模块 3、无线信号收发相关模块 CPU和内存 CC2530使用的8051CPU是一个单周期的兼容内核，它有三种不同的访问总线。其中包括中断控制器，内存仲裁器，8KB SRAM，32/64/128/256KB闪存块。 中断控制器：其为18 个中断源提供服务，它们中的每个中断都被赋予4 个中断优先级中的某一个。 内存仲裁器：位于系统中心，它负责执行仲裁，即决定同时访问系统物理存储器时的顺序，便于系统效率的提高。 8 KB SRAM：超低功耗，使数字部分即使掉电也能保存其中内容，是芯片低功耗原因所在。 闪存块：用于保存电脑传输进入的程序代码以及常量数据，节约了搜寻时间。 CC2530外设 两个8位定时器：定时