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2017-07-06 发布于河南
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4外围和NIOSII

第4章 Nios II 外围设备;本章介绍了Nios II处理器常用外围设备(Peripherals)内核的特点、配置以及软件编程，供读者在使用这些外设定制Nios II系统时查阅。这些外设都是以IP核的形式提供给用户的,用户可以根据实际需要把这些IP核集成到Nios II系统中去。主要介绍：硬件结构；内核的特性核接口； SOPC Builder中各内核的配置选项；软件编程。;第4章目录;4.1 并行输入/输出内核;4.1 并行输入/输出内核;4.1 并行输入/输出内核;4.1 并行输入/输出内核;4.1 并行输入/输出内核;4.1 并行输入/输出内核;4.1 并行输入/输出内核;4.1 并行输入/输出内核;4.1 并行输入/输出内核;第4章目录;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;4.2 SDRAM控制器内核;第4章目录;4.3 CFI控制器内核;4.3 CFI控制器内核;4.3 CFI控制器内核;4.3 CFI控制器内核;;第4章目录;4.4 EPCS控制器内核;4.4 EPCS控制器内核;4.4 EPCS控制器内核;4.4 EPCS控制器内核;4.4 EPCS控制器内核;第4章目录;4.5 定时器内核;4.5 定时器内核;4.5 定时器内核;4.5 定时器内核;4.5 定时器内核;4.5 定时器内核;4.5 定时器内核;4.5 定时器内核;4.5 定时器内核;4.5 定时器内核;第4章目录;4.6 UART内核;4.6 UART内核;4.6 UART内核;4.6 UART内核;4.6 UART内核;4.6 UART内核;第4章目录;4.7 JTAG_UART内核;4.7 JTAG_UART内核;4.7 JTAG_UART内核;4.7 JTAG_UART内核;4.8 SPI内核;4.8 SPI内核;4.8 SPI内核;4.8 SPI内核;4.8 SPI内核;4.8 SPI内核;第4章目录;4.9 DMA内核;4.9 DMA内核;4.9 DMA内核;4.9 DMA内核;4.9 DMA内核;4.9 DMA内核;第4章目录;4.10 带Avalon接口的互斥内核;4.10带Avalon接口的互斥内核;4.10带Avalon接口的互斥内核;4.10带Avalon接口的互斥内核;4.11 带Avalon接口的邮箱内核;4.11 带Avalon接口的邮箱内核;4.11 带Avalon接口的邮箱内核;4.11 带Avalon接口的邮箱内核;4.11 带Avalon接口的邮箱内核;4.11 带Avalon接口的邮箱内核;第4章目录;4.12 System ID内核;4.12 System ID内核;4.12 System ID内核