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视频处理子系统 (VPSS)DM6437 VPSS提供一个VPFE输入接口，连接外部设备如图像传感器，视频解码器等，以及一个VPBE输出接口，连接显示设备，如analog SDTV显示器，数字LCD面板，HDTV视频编码器等。VPSS相关寄存器有PID,PCR(VPSS control reg)等。a. VPFEVPFE包括CCD控制器(CCDC),Preview Engine, Resizer, Hardware 3A(H3A) Statistic Generator, Histogram blocks. 这些模块给DM6437提供了灵活有力的前端接口，大致描述如下： CCDC提供一个图像传感器和数字视频源接口 Preview Engine是一个带参数的硬件图像处理模块，它用于原始彩色数据的转换:从Bayer类型转换到YUV422 Resizer模块缩放输入图像数据，以满足显示播放霍视频编码程序希望的分辨率 H3A模块控制Auto Focus(AF),Auto White Balance(AWB), Auto Exposure(AE) 直方图模块处理彩色象素获取统计信息，提供给H3A模块实现各种3A算法，以平滑最终的输出图像/视频VPFE相关寄存器有: CCDC(controller), PREV(preview engine/image signal processor), RESZ(resizer), HIST(Histogram), H3A(AF/AWB/AE), VPSS(VPSS Shared Buffer Logic Reg)CCDC:CCDC从传感器(CMOS,CCD)接收图像/视频数据或从视频解码器设备接收各种格式的YUV数据。这个模块支持以下功能特征： 常用的Bayer类型格式 产生HD/VD计时信号 提供至逐行和隔行传感器的接口 支持REC656/CCIR-656 标准(YCbCr 4:2:2 format, either 8- or 16-bit). 支持YCbCr 4:2:2格式，8- 或16-bit的离散H和VSYNC信号 支持高达16-bit的输入 快门信号控制 Digital clamping and black level compensation. 支持10-bit到8-bit的A-law压缩 写SDRAM前做低通滤波。如果此滤波功能被启用，则输出图像每行最左右2个象素点被裁剪掉了 输出数据范围从16-bit到8-bit(按8-bit输出要节省一半的存储空间) 支持可编程的下采样 通过一个外部写使能信号控制向DDR2的输出 水平和垂直方向都支持高达16k象素的图像尺寸CCDC相关寄存器的内存映射212，没有位域说明。Preview Engine:Preview Engine将来自传感器(CMOS/CCD)的未压缩的原始图像/视频数据转变成YCbCr 4:2:2数据。Preview Engine的输出可以用于视频压缩和外部显示设备，如NTSC/PAL模拟编码器或数字LCD显示。总括支持以下特点: 接受传统的Bayer类型格式(Bayer pattern formats是什么格式?) 获取来自CCD/CMOS控制器或DDR2内存的图像/视频数据 支持1280象素宽的输出 若执行边界处理，可实现自动/强制的象素/行裁剪。如果所有相应模块被使能，则输出图像的左右各7列象素及上下各4行象素被裁剪 对超过1280象素宽度的输入图像做简单的水平均值化(均值因子2，4或8) 捕捉Dark帧存储到DDR2 从DDR2获取Dark Frame,对每个输入的原始帧数据做Dark帧减操作，逐象素的改善视频帧质量 镜头阴影补偿。每个输入象素乘以一个相应的8-bit增益值，结果做右移处理，右移位数可编程(0-7 bits) 通过A-LAW解压缩将8-bit非线性数据转换成10-bit的线性数据。这个特性使得保存至DDR2的数据可以是8-bit宽，由此若从DDR2读取数据到preview engine，则可以节省一般的空间 通过水平均值滤波来减小温度变化导致的象素噪声 支持可编程的噪声滤波器 支持数字增益与白平衡 可编程的CFA插值，一次操作5x5的象素块 常规的Bayer pattern RGB和带补偿的色度传感器 支持图像水平和垂直方向下采样，采样比率为2 可编程的RGB-to-RGB混合矩阵(3x3矩阵的9个系数) 支持可编程的伽马纠正 可编程的颜色分量转换(RGB to YUV)系数(3x3矩阵的9个系数) 支持亮度分量增强(非线性)以及色度分量抑制和偏移处理Preview Engine相关寄存器地址映射214。Resizer:resizer模块可以从preview engine或DDR2接收图像/视频数据，输出