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B3G系统关键技术的FPGA设计与实现——同步、OFDM解调.pdf 75页

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图形列表 图形列表 图2-1 图2-2Virtex.IIPro系列产品结构示意图….………………………….…………8 图2-3AD6644内部结构框图…………………………………………………….9 图3-1插入循环前缀的OFDM符号……..…………………….…………一11 图3-2OFDM系统框图………………………………………………………….12 图3-3B3GTDD下行链路的系统帧结构…………………………………..17 B3G ……………………………………18 图3-4 TDD下行链路的基本框架 图3-5同步时隙结构图……………………………………………………18 图3-6下行同步码结构图…………………………………………………………19 图3—7 时间同步的算法流程………………………………………………………20 图3-8OFDM系统基本模型框图..……………………………………….24 B3G 图4-1 TDD下行链路的硬件系统架构框图………………………………27 图4-2多天线接收板的设计框图………………………………………….28 图4-3多天线接收板的算法流程………………………………………………一29 图4—4 同步模块的FPGA设计框图…………………………………….29 图4.5 时间同步模块的结构框图……………………… …………….30 图4-6适应门限的结构框图………………………………….………………….31 图4.7 时问同步模块仿真波形图…………………………………………………32 图4,8 频率粗同步模块的结构框图………………… ………………….33 图4-9粗频偏估计子模块的结构框图………………………………………..33 图4—10粗频偏估计子模块仿真波形图………………………………………34 图4-11粗频偏补偿模块的结构框图………………………………………………34 VI 图形列表 化2 CORDICV3.0 图 IP核的结构框图…………………………………………36 邶3 州4 频率精同步模块的结构框图……………………………………………一38 似5 定时恢复模块的结构框图………………………………………………39 蛳6 定时恢复模块的仿真波形图……………………………………………39 伽7 常见DPLL的结构框图…………………………………………………..40 榔8 累加型DCO的结构框图………………………………………………..41 伽9 相位比较器和SAR的简化结构框图……………………………………41 蚴O DPLL的仿真波形图……………………………………………………42 蚴1 同步信号的格式说明………………………………………………………42 §!2 PowerPC与接口关系图…………………………………………………..43 蚴3 同步与OFDM解调芯片间数据传送格式………………………………44 似4 秘5 FFT核外部引脚图………………………………………………………46 秘6 插入序号模块的结构框图……………………………………………….48 埘7 插入序号后OFDM符号格式…………………………………………….49 螂B 插入序号模块的仿真波形图………………………………………….49 蚴) Rocket I/O内部结构框图.……………………………………………..50 ㈣) Rocket I/O接口结构框图………………………………………………….52 0 纠 RocketI/O接口仿真波形图………………………………………………53 ¨ 测试单路ADC接口模块接收正弦波……………………………………55 。: 测试多路ADC接口模块接收正弦波………………………………….55 粥 测试ADC接口模块接收实际数据…………………………………..56 图图图图图图图图图图图图图图图图图图图图图图图 舛 测试时问同步及尾帧检测模块……………………

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