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《EDA工具手册》原理图分册 中兴通讯康讯EDA设计部
《EDA工具手册》原理图分册 中兴通讯康讯EDA设计部
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目录
TOC \o "1-3" \h \z 目录 1
前言 8
1 原理图输入介绍 9
2 项目管理器 11
2.1 项目管理器的概念 11
2.2 项目的结构 11
2.3 创建或打开一个项目 12
2.4 原理图库的添加: 13
2.5 填写设计(Design)名称 13
2.6 增加新的Design(设计) 14
2.7 修改cds.lib文件 15
2.8 设置工具 15
2.9 项目文件 16
3 原理图设计-基本操作 17
3.1 创建原理图的流程 17
3.1.1 创建原理图的流程请见下图: 17
3.1.2 创建一个层次化原理图的流程请见下图: 18
3.2 图纸版面设置 19
3.2.1 图纸统一格式设置 19
3.3 Concept编辑环境 21
3.3.1 栅格设置 22
3.3.2 原理图中的文字设置 23
3.4 添加首页和目录页 23
3.4.1 原理图目录页的格式 23
3.4.2 目录表 24
3.5 页面操作 25
3.5.1 增加、删除、插入新的原理图页 25
3.5.2 原理图多页面操作 26
3.5.3 删除某个设计、设计视图或者某页原理图 26
3.6 基本界面操作 26
3.6.1 常用的快捷键 27
3.6.2 笔画命令 27
3.7 基本命令 28
3.7.1 基本编辑命令 28
3.7.2 基本显示命令 29
3.7.3 两个不同网络名的网络连接的方法 29
3.7.4 检查连接关系 30
3.7.5 保存设计 30
3.7.6 打开设计和恢复设计 30
3.7.7 Drawing 符号 31
3.8 Design Entry HDL的模式 31
3.9 添加元件 31
3.9.1 在Design Entry HDL中添加器件 31
3.9.2 修改替换元件 32
3.9.3 定义Physical Property Options 32
3.9.4 Section元件 33
3.9.5 使用库浏览器PartBrowser调用元件 34
3.10 多窗口添加元件 36
3.11 画线 37
3.11.1 Draw方式 37
3.11.2 Route方式 38
3.12 添加信号名 38
3.12.1 电源信号命名规定: 39
3.12.2 差分信号命名规定: 40
3.12.3 局部和全局信号命名规定 40
3.12.4 逻辑低和双逻辑信号命名规定: 40
3.12.5 总线信号命名规定: 40
3.13 画总线 41
3.14 元件位号手工标注 43
3.15 加端口 44
4 属性和文本 45
4.1 Design Entry HDL属性 45
4.1.1 锁住属性 45
4.1.2 拷贝属性 45
4.1.3 添加属性 46
4.1.4 区分大小写的属性名称和属性值 47
4.1.5 指定电源管脚 47
4.2 文字操作 50
4.2.1 定义文本宏 51
4.3 定制文本 52
5 群组 55
5.1 群组定义: 55
5.10.2 组命名 55
5.10.3 组操作 56
6 模块设计 58
6.1 关于模块 58
6.2 模块符号创建 58
6.3 创建层次图 58
6.3.1 Top Down 方法 59
6.3.2 Bottom Up 方法 59
6.3.3 模块的操作 60
6.4 模块排序 60
7 约束管理器 63
7.1 层次设计中的电子约束 64
8 信号完整性分析特性 67
8.1 支持Xnets 67
8.1.1 创建Xnets 67
8.1.2 在约束管理器中显示Xnet 67
8.1.3 处理Xnet上的分段约束 68
8.1.4 在原理图中显示管脚对约束 68
8.1.5 在约束管理器和D
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