【全国一等奖】2011全国大学生电子设计竞赛E题——简易数字信号传输性能分析报告仪李博.pdf

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实用文档 简易数字信号传输性能分析仪 (E题) 国防科技大学 作者:李博,李安冬,赵本东 赛前辅导教师:××× 文稿整理辅导教师:××× 摘要:本系统提出基于双 FPGA的简易数字信号传输性能分析仪。利用前级 FPGA产生程控数字信号和高频伪随机噪声,经过继电器切换带宽及增益可变的 滤波器模拟的传输信道,和由π型衰减网络、 AD603程控放大实现的 AGC网络, 最终送入后级 FPGA提取同步时钟信号,并在 TFT 液晶屏上显示眼图。整个系统 经过严格测试,各项指标合格。 关键字:数字信号分析仪 滤波器 FPGA TFT液晶屏 眼图 Abstract: The system put forward a kind of simple digital signal transmission performance analyzer based on two-FPGA combination. The pre-programmed digital signal and high-frequency noise are generated by the first FPGA. Going through the analog transmission channel simulated by the filter of Variable-gain bandwidth, and the AGCnetwork with π-type network and AD603programmable Amplifier, the signal is send to another FPGA for synchronous clock extraction. Signal eye diagram are displayed on the TFT-LCD screen. The entire system had been through rigorous testing, and all the indicators are qualified. Keys: digital signal analyzer, filter, FPGA, TFT-LCD, Eye diagram. 文案大全 实用文档 1 系统方案 本系统主要由数字信号和伪随机信号发生模块、低通滤波器模块、数字信号分析 模块组成,下面分别论证这几个模块的选择。 1.1 数字信号和伪随机信号发生模块的论证与选择 方案一 数字信号发生器可采用通用的数字 IC 和 555 电路来实现。但是这种方案的 硬件电路庞杂,而且时钟频率稳定度比较低,调试和实现较为困难。 方案二 利用单片机编程模拟数字电路产生的数字信号, 频率由改变定时器参数来控 制。但是这种方案中单片机自身频率较低,无法产生符合要求的噪声信号。 方案三 充分利用 FPGA的强大可编程能力,用 verilog 语言编程,很容易要求的 M 序列发生器。这种方案充分发挥 FPGA并行处理能力,做到了资源的合理分配利用。 综合考虑采用方案三。 采用 FPGA构建线性反馈的移位寄存器, 产生曼彻斯特编码的 信号 M序列和伪随机噪声序列。 1.2 低通滤波模块的论证与选择 方案一:采用可编程开关电容滤波器,例如 linear 公司的 LTC1068,美信公司的 MAX260,这种滤波器外接电路简单,通带阻带特性均可由相应公司的软件设计,截止频 率仅决定于时钟频率,操作方便,但

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