使用SignalTapⅡ逻辑分析仪调试FPGA_图文.doc

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45 EL EC TR ON IC P RO DU CT S CH I NA MAY 2005 可编程逻辑器件专题 使用SignalTap II 逻辑分析仪调试FPGA 使用SignalTap II 逻辑分析仪调试FPGA Design debugging of FPGA using SignalTapII embeded logic analyzer 西安交通大学电气工程学院   郭佳佳  胡晓菁  王永良 1 概述 随着F P G A 容量的增大 设计调试成为一个很繁 重的任务 设计人员需要一种简易有效的测试工具 传统的逻辑 分析仪在测试复杂的FPGA 设计时 1 设计中器件的选择依据设计规模而定 2 设计者为减小电路板的面积 在不改变 PCB 板布线的情况下引出I/O 引脚非常困难 外接逻辑分析仪有改变FPGA 设计中信号原来状态的可能 4 将会加重设计方的经济负 担 一种 新的调试工具Quartus II 中的SignalTap II 满足了FPGA开发中硬件调试的要求 便于升级 价格低廉等特点 并 以一个实例介绍该分析仪具体的操作方 法和步骤能够捕获和 显示可编程单芯片系统设计中 实时信号的状态它支持多达1024 个通道 每个分 析仪均有10级触发输入/输出SignalTap II为设计 者提供了业界领先的SOPC 设计的实时 可视性目前SignalTap II逻辑分析 仪支持的器件系列包括 SignalTap II将逻辑分析模块嵌入到FPGA 中 逻辑分析模 块对待测节点的数据进行捕获 使用SignalTap II无需 额外的逻辑分析设备 SignalTap II 对FPGA 的 引脚和内部的连线信号进行捕获后 因此 使用SignalTap II的一般流程是 建 立SignalTap II (.stp文件并加入工程 编译并下载设计到 FPGA 在测试完毕后将该逻辑分 析仪从项目中删除 1 采样时钟决定了显示信号波形的分辨率 否则无法正确 反映被测信号波形的变化 2 可以使用Node Finder 中的 SignalTap II 滤波器查找所有预综合和布局布线后的SignalTap II 节点 逻辑分析 器不可测试的信号包括 P L L 的时钟输出 L V D S 信号 配置采样深度 SignalTap II所能显示的被测信号波形的时间长度为T x T x = N 本文介绍了可编程逻辑器件开发工具Quartus II 中SingalTap II 嵌入式逻辑分析器的使用 详细介绍使用SignalTap II对FPGA调试的具体方法和步骤  SignalTap 图1  SignalTap II嵌入式逻辑分析器 2005/5 46 T s ?a 2é?ùê±?óμ??ü?ú éè??buffer acquisition mode á?D?′?′¢á????£ê? ???????o′?·?3é?à ??????(segment ??1|?ü?éò?è¥μ??T1? μ?êy?Y 5 SignalTap II ?§3??à ′¥·¢??μ?′¥·¢·?ê? 6 ?éò?éè?¨?′?óμ?′¥·¢ ì??tó?à′2????àó|μ?êy?Y μ±′¥·¢ì??t?ú×?ê± íê3éSTPéè??oó ?úQuartus II ?DSignalTap II ′°?ú??2é?′???-·???ò?2????á1? ò?1?íaéèμ??? ?-·????÷ê1ó? tbl vwf???t??ê?ò?1?μúèy·?·???1¤??ê1ó???ì??μ?÷è?o?ó? SignalTap II à′??DDFPGA éè??μ??é?¤ ???÷?t?§ 3?SignalTap II ??è?ê????-·???ò?μ?ê1ó? êy×? ±??μ?÷μ?±??μê?3?ìá1?A D C ?????÷μ? 2é?ù′¥·¢??3? ?ù?Y??2ù×÷ê± Dò 2é?ùμ?ê±?úóé±??μ?÷à′?? ?? ?ò í£?1μè′y??ò???′¥·¢??3?μ?μ?à′ ADC 2é?ù?? ???÷μ?×′ì??ú??DDò?′?2é?ù2ù×÷ íê3é±?2aD?o?ò??? ?ù2¨?ü?úN??μ?μ?μè????2é?ù ???é?üμ?±£3?N??μ?μ?2é?ù?í?è?yo??a±?2aD?o?ò????ü2¨μ??í?è ?üê?ó?×′ì??ú????μ??ü?úD?μ????′ê??t ?aê???ò?′?μ?2é?ù ?úS T P???t?D??b u f f e r acquisition mode ·?±eéè?aá?D?′?′¢oí?-?·2é?ù′?′¢

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