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时钟门控单元包括输入逻辑/锁存电路、保持器逻辑/信号生成电路和输出驱动器。输入逻辑/锁存电路基于第一输入启用信号和第二输入启用信号来生成内部启用信号,并且基于内部启用信号和输入时钟信号来生成向第一节点提供的第一内部信号。保持器逻辑/信号生成电路连接在第一节点与第二节点之间,包括反馈第一内部信号的反馈路径,基于第一内部信号和输入时钟信号生成向第二节点提供的第二内部信号,并且包括使第二节点放电的第一路径和第二路径。第一路径和第二路径不同。第二路径连接到反馈路径。输出驱动器基于第二内部信号生成输出时钟
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112583398 A
(43)申请公布日 2021.03.30
(21)申请号 202010964224.X
(22)申请日 2020.09.14
(30)优先权数据
10-2019-0
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