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本发明公开了一种基于数字化直接线性相位比对的动态锁相环,频率变换电路依次经ADC模块、FPGA模块和低通滤波器后与压控电压振荡器VCXO连接,频率变换电路将输入的参考信号处理成控制ADC模块转换速率的时钟信号并发送至ADC模块;FPGA模块接收ADC模块处理后参考信号输出PWM波给低通滤波器,低通滤波器将PWM波处理成对应的直流电压,通过改变压控电压振荡器VCXO的压控电压输出;压控电压振荡器VCXO经幅度预处理电路进行线性变换后发送至ADC模块;实现基于数字化直接线性相位比对的动态锁相环,利用
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 111865304 A
(43)申请公布日 2020.10.30
(21)申请号 202010802460.1
(22)申请日 2020.08.11
(71)申请人 长安大学
地址 71
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