EDA实验简易音乐发生器综合设计.docVIP

乐山师范学院物电学院 EDA综合设计实验报告 实验名称：简易音乐发生器设计 第一部分：设计课题及总体要求简介 设计目标：简易音乐发生器设计 设计任务：1、学习存储器的定制与应用。 2、学习数控分频器涉及硬件乐曲演奏电路。 第二部分：设计方案与工作原理说明 组成乐曲的每个音符的发音频率值及其持续的时间是乐曲能连续演奏所需的2个基本要素。乐曲的12平均率规定：每2个八度音(如简谱中的中音1与高音1)之间的频率相差1倍。在2个八度音之间，又可分为12个半音，每2个半音的频率比为。另外，音符A(简谱中的低音6)的频率为440Hz，音符B到C之间、E到F之间为半音，其余为全音。由此可以计算出简谱中从低音1至高音1之间每个音符的频率 第三部分：单元模块功能介绍及程序（部分） 各模块（元件）说明： notetab部分: library ieee; use ieee.std_logic_1164.all; use ieee.std_logic_unsigned.all; entity notetab is port(clk:in std_logic; toneindex:out std_logic_vector(3 downto 0)); end; architecture one of notetab is component music01 port(address:in std_logic_vector (7 downto 0); inclock: in std_logic; q:out std_logic_vector(3 DOWNTO 0)); END component; signal counter:std_logic_vector(7 downto 0 ); begin cnt8:process(clk,counter) begin if counter=138 then counter elsif (clkevent and clk =1)then counter=counter+1; end if;end process; u1: music01 port map(address=counter,q=toneindex,inclock=clk); end; tonetaba部分： library ieee; use ieee.std_logic_1164.all; entity tonetaba is port(index:in std_logic_vector(3 downto 0); code: out std_logic_vector(3 downto 0); high: out std_logic; tone: out std_logic_vector(10 downto 0)); end; architecture one of tonetaba is begin search: process(index) begin case index is when0000=tone=11111111111;code=0000;high=0; when0001=tone=01100000101;code=0001;high=0; when0010=tone=01110010000;code=0010;high=0; when0011=tone=10000001100;code=0011;high=0; when0101=tone=10010101101;code=0101;high=0; when0110=tone=10100001010;code=0110;high=0; when0111=tone=10101011100;code=0111;high=0; when1000=tone=10110000010;code=0001;high=0; when1001=tone=10111001000;code=0010;high=1; when1010=tone=11000000110;code=0011;high=1; when1100=tone=11001010110;code=0101;high=1; when1101=tone=11010000100;code=0110;high=1; when1111=tone=11011000000;code=0001;high=1; when others=null; end case; end process; end; speakera部分： library ieee; use ieee.std_logic_1164.all; use ieee.std_logic_unsigned.a