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一、异步二进制计数器 异步二进制加法计数器 F1 J Q CP K Q0 Q2 F0 J Q K F2 J Q K Q1 0 012345670 计数顺序 等效十进制数 Q2 Q1 Q0 0 0 0 0 1 0 1 0 1 1 1 1 1 0 0 0 0 0 1 1 1 0 0 0 0 1 1 J0＝K0＝1 J1＝K1＝1 J2＝K2＝1 CP1＝Q0 CP2＝Q1 1 2 3 4 5 6 7 8 状态表 CP 时序图 1 2 3 4 5 6 7 8 Q2 Q0 Q1 若CP的频率为f0，则Q0、Q1、 Q2的频率分别为f0／2， f0／4， f0／8。所以计数器有分频作用。 一个触发器可表示一位二进制数，N个触发器可表示N位二进制数，构成N位二进制计数器，也可称为2N进制计数器。可计（2N－1）个脉冲，实现2N分频。 如：四触发器构成的计数器，称为2N＝16进制计数器。可计15个脉冲，实现16分频。 D触发器构成的异步二进制加法计数器 F1 Q CP D Q0 Q2 F0 Q D F2 Q D Q1 二、同步二进制计数器 F1 J Q CP K Q0 Q2 F0 J Q K F2 J Q K Q1 ＆ J0＝K0＝1 J1＝K1＝Q0 J2＝K2＝ Q0 Q1 翻转条件： Q0＝1，F1翻转 Q0 Q1 ＝1，F2翻转 触发器在满足翻转条件的情况下，CP脉冲到来时可同时翻转，其速度比异步式快。 三、十进制计数器 F1 J Q CP K Q0 Q2 F0 J Q K F2 J Q K Q1 Q3 F3 J Q K 异步十进制计数器 状态表 0 0 0 0 0 0 0 0 1 0 1 0 1 0 1 1 1 0 1 0 0 0 0 0 1 1 0 0 0 0 0 1 1 1 2 3 4 5 6 7 8 9 10 0 1 0 1 1 1 0 0 0 0 0 0 CP Q3 Q2 Q1 Q0 J3=Q2Q1 J2=K2=1 J1=Q3 J0= K0=1 K3 = 1 K1=1 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0 0 0 0 0 1 1 0 0 1 1 1 1 1 1 1 1 0 0 同步十进制计数器 F1 J Q CP K Q0 Q2 F0 J Q K F2 J Q K Q1 Q3 F3 J Q K 考 试 通 知 考试时间: 5月28日(第12周周六) 上午 8:30~10:30 (逸) 440906班 (逸) 440907班 (逸) 440908班 (逸） 重修 第十五章 双稳态触发器和 时序逻辑电路 第一节 基本双稳态触发器 第二节 钟控双稳态触发器 第三节 寄存器 第四节 计数器 * 第五节 集成计数器 时序逻辑电路与输出状态不仅与输入变量有关，而且还与系统先前的状态有关。 时序逻辑电路的特点： ①包括组合逻辑电路和具有记忆功能的电路或反馈延迟电路。 ②输入、输出之间至少有一条反馈路径。 触发器是时序逻辑电路的基本单元，是一种具有记忆功能的逻辑电路。能够储存一位二值信号。 第一节 基本双稳态触发器 双稳态触发器的特点： ⑴ 具有两个能自行保持的稳定状态； ⑵ 根据不同的输入信号可以置成“1”状态或“0”状态； ⑶ 在输入信号消失后，如果没有新的信号输入，能够保持原状态，直至下一个新的信号输入为止。 基本R－S 触发器 RD SD Q 0 1 1 0 1 1 0 0 Q 0 1 1 0 两个输出端反相，规定Q的状态为触发器的状态。即Q＝0，Q=1时，称触发器为0态，又称复位； Q＝1，Q=0时，称触发器为1态，又称置位。 不 变 *不 定 RD＝0，SD=1 触发器复位为0态，称RD为复位端；RD＝1，SD=0 触发器置位为1 态，