第3章 EDA.ppt

EDA 技术实用教程 第 3 章 FPGA/CPLD 结构与应用 3.1 概 述 3.1 概 述 3.1 概 述 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.2 简单可编程逻辑器件原理 3.3 CPLD的结构与工作原理 3.3 CPLD的结构与工作原理 3.3 CPLD的结构与工作原理 3.3 CPLD的结构与工作原理 3.3 CPLD的结构与工作原理 3.3 CPLD的结构与工作原理 3.3 CPLD的结构与工作原理 3.4 FPGA的结构与工作原理 查找表 查找表（Look-Up-Table)简称为LUT，LUT本质上就是一个RAM。 目前FPGA中多使用4输入的LUT，所以每一个LUT可以看成一个有4位地址线的16x1的RAM。 当用户通过原理图或HDL语言描述了一个逻辑电路以后，PLD/FPGA开发软件会自动计算逻辑电路的所有可能的结果，并把结果事先写入RAM,这样，每输入一个信号进行逻辑运算就等于输入一个地址进行查表，找出地址对应的内容，然后输出即可。 查找表（Look-Up-Table)的原理与结构 4输入与门的例子 查找表结构的FPGA逻辑实现原理 FPGA实现下面的电路 查找表结构的FPGA逻辑实现原理 A,B,C,D由FPGA芯片的管脚输入后进入可编程连线，然后作为地址线连到到LUT，LUT中已经事先写入了所有可能的逻辑结果，通过地址查找到相应的数据然后输出，这样组合逻辑就实现了。 该电路中D触发器直接利用LUT后面D触发器来实现。时钟信号CLK由I/O脚输入后进入芯片内部的时钟专用通道，直接连接到触发器的时钟端。触发器的输出与I/O脚相连，把结果输出到芯片管脚。这样PLD就完成了所示电路的功能。（以上这些步骤都是由软件自动完成的，不需要人为干预）??? 这个电路是一个很简单的例子，只需要一个LUT加上一个触发器就可以完成。对于一个LUT无法完成的的电路，就需要通过进位逻辑将多个单元相连，这样FPGA就可以实现复杂的逻辑。 3.4 FPGA的结构与工作原理 以Cyclone II FPGA 为例，逻辑单元(Logic Element，LE)是构成FPGA 的基本单位之一，一个LE 主要由一个4 输入查找表、一个寄存器及进位和互连逻辑组成。 查找表也可以把它当作一个4 输入的函数发生器，能够实现四变量输入的所有逻辑。上图 是Cyclone II FPGA 的一个LE 的普通工作模式原理图。FPGA 的基本单元一般为一个4 输入查找表后接一个寄存器。 3.4 FPGA的结构与工作原理 CPLD与FPGA的硬件对比 CPLD与FPGA的特性对比 ＣＰＬＤ和ＦＰＧＡ各自的特点: ①ＣＰＬＤ更适合完成各种算法和组合逻辑，ＦＰ ＧＡ更适合于完成时序逻辑。换句话说，ＦＰＧＡ更适合于触发器丰富的结构，而ＣＰＬＤ更适合于触发器有限而乘积项丰富的结构。 ?②ＣＰＬＤ的连续式布线结构决定了它的时序延迟是均匀的和可预测的，而ＦＰＧＡ的分段式布线结构决定了其延迟的不可预测性。 ?③在编程上ＦＰＧＡ比ＣＰＬＤ具有更大的灵活性。ＣＰＬＤ通过修改具有固定内连电路的逻辑功能来编程，ＦＰＧＡ主要通过改变内部连线的布线来编程；ＦＰ ＧＡ可在逻辑门下编程，而ＣＰＬＤ是在逻辑块下编程。 ＣＰＬＤ和ＦＰＧＡ各自的特点: ④ＦＰＧＡ的集成度比ＣＰＬＤ高，具有更复杂的布线结构和逻辑实现。 ?⑤ＣＰＬＤ比ＦＰＧＡ使用起来更方便。ＣＰＬＤ的编程采用Ｅ2ＰＲＯＭ或ＦＡＳＴＦＬＡＳＨ技术，无需外部存储器芯片，使用简单。而ＦＰＧＡ的编程信息需存放在外部存储器上，使用方法复杂。 ?⑥ＣＰＬＤ的速度比ＦＰＧＡ快，并且具有较大的时间可预测性。这是由于ＦＰＧＡ是门级编程，并且ＣＬＢ之间采用分布式互联，而ＣＰＬＤ是逻辑块级编程，并且其逻辑块之间的互联是集总式的。 ＣＰＬＤ和ＦＰＧＡ各自的特点: ⑦在编程方式上，ＣＰＬＤ主要是基于Ｅ2ＰＲＯＭ或ＦＬＡＳＨ存储器编程，编程次数可达1万次，优点是系统断电时编程信息也不丢失。