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第一章数字逻辑概论
1、41,.5,625
2、(37) ( 100101 )B ( 45 )O (25)H
(43) ( 101011 )B ( 53 )O (2B)H
(44.4375) ( 101100.0111 )B ( 54.34 )O ( 2C.7 )H
3、已知格雷码为1000,二进制码为___1111_____,
已知十进制数为92,其余三码为________,
将二进制1100110转换成余3码为_,转换成格雷码为_____。
45、(12)000100100111(3)0010010101004)0010.01XXXXXXXXXX
6、(1)29,(2)3.68
7、(1)0010 0011 1111.0100 0101(2)1010 0000 0100 0000.0101 0001
8、(1)259.125(2)42077.459
第二章 逻辑代数与硬件描述语言基础
1、与, 或, 非, 与非,或非,异或, 同或, 与或非
2、,
3、
4、
5、×, ×, √
6、 1 2 3 4 5 6 7 8
7、 1 ×, 2 m7, 3 ×, 4 ×, 5 ×, 6 ×
8、 3,6,7,11,12,13,14,15
9、 1 011、101、110、111, 2 000、001、010、100 3 001、010、011、100、110、111, 4 001、010、100、111
10、⑴ ⑵
11、⑴ ⑵ 3 4
第三章 逻辑门电路
1、开关, 截止, 2.3V, b, 加深, 减轻, 加速
2、3V, 0.3V, 1.4mA, 0.02mA, 1.5V, 1.5V, 1.5V, 1.2V, 1.5V, 15mA, 10
3、高电平, 1.4V
4、输出与电源
5、极低, 增加, 很大, 高
6、高电平, 1.4V
7、图略
8、图略
9、
10、图略
第四章组合逻辑门电路
3、
5、a b
6、a 为奇偶校验器
b ,为全加器
7、
8、,,
9、
10、 ,不一致电路
17、 第五章锁存器和触发器
1、,
2、, 0
3、5
4、T
7、
8、 D AB
第六章 时序逻辑电路
1、输入信号, 原来的状态
2、异
3、n
4、4, 4
5、反馈清零、反馈置数
6、N
7、状态方程和输出方程:
8、激励方程
状态方程
输出方程 Z AQ1Q0
根据状态方程组和输出方程可列出状态表,如表题解6.2.4所示,状态图如图题解6。2.4所示。
14、
15、状态方程为:
24、解:74HC194功能由S1S0控制
00 保持, 01右移 10 左移 11 并行输入
当启动信号端输人一低电平时,使S1 1,这时有S。=Sl=1,移位寄存器74HC194执行并行输人功能,Q3Q2Q1Q0=D3D2D1D0=1110。启动信号撤消后,由于Q。=0,经两级与非门后,使S1 0,这时有S1S0=01,寄存器开始执行右移操作。在移位过程中,因为Q3Q2、Q1、Q0中总有一个为0,因而能够维持S1S0 01状态,使右移操作持续进行下去。其移位情况如图题解6,5,1所示。
该电路能按固定的时序输出低电平脉冲,是一个四相时序脉冲产生电路。
第七章 半导体存储器和可编程逻辑器件
ROM, RAM, 存取方式不同
MROM, PROM, E2PROM
SRAM, DRAM
存储单元的总和, 211, 8, 11
1024, 4, 8
字扩展, 位扩展, 字位扩展
PROM, PLA, PAL, GAL
输入电路, 与阵列, 或阵列, 输出电路
固定, 可编程
可编程, 可编程
可编程, 固定
12、B 13、C 14、D 15、A 16、B 17、A
18、解: 因为(1K×8)/(1K×4) 2,所以需要2片1K×4的RAM。
又,1K 210,所以需要10根地址线。
扩展连接如下图所示。
19、因为(4K×8)/(1K×8) 4,所以需要4片1K×8的RAM。
又,4K 212,所以组成4K的存储器共需要12根地址线。
而,1K 210,所以10根作字选线,选择存储器芯片内的单元 。
地址A10、A11可利用2线-4线二进制译码器74LS139,以产生片选信号,分别去选通4片存储器芯片,从而实现字扩展。如果要扩展3位地址,则可选用3线-8线二进制译码器74LS138。
扩展连接如下图所示。
20、
21、
第八章 脉冲波形的产生与变换
4、(1)工作原理(略
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