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* 数字逻辑电路 组合逻辑电路 时序逻辑电路 输出状态只决定于当前时刻各输入状态的组合，而与电路先前状态无关(无记忆功能) 。 输出状态不仅决定于当前时刻各输入状态的组合，而且还与电路先前状态有关(有记忆功能) 。 第21章 触发器和时序逻辑电路 门电路是组合电路的基本单元 触发器是时序电路的基本单元 按功能分类：R-S触发器、D型触发器、JK触发器、T型触发器等。 按稳定工作状态：双稳态、单稳态、无稳态触发器（多谐振荡器） 按结构分类：基本型、同步型、主从型、维持阻塞型。 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * 反馈 两个输入端 两个输出端 逻辑图 逻辑符号 Q=1，Q =0时，称触发器处于置位状态（1态）； Q=0，Q=1时，称触发器处于复位状态（0态）。 现态——输入信号作用前的状态，用Qn和Qn(或Q、Q)表示； 次态——输入信号作用后的状态，用Qn+1和Qn+1表示。 SD——置1端或置位(SET)端； RD——置0或复位(RESET)端。 21.1.1 RS触发器 21.1 双稳态触发器 1. 基本RS触发器 SD RD Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * (1) 输入RD=0, SD=1时 1 0 0 1 输出： （2）输入RD=1, SD=0时 0 1 1 0 a b 输出： 触发信号——输出端状态改变时输入端所加的有效信号。 翻转——输出端状态的转换过程。 基本RS触发器又称为置0置1触发器，或置位复位触发器。 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * 若原状态： 1 0 1 1 1 0 0 1 输出保持原状态： a b 0 1 1 1 0 1 1 0 a b 若原状态： 输出保持原状态： (3) 输入RD=1, SD=1时 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * (4) 输入RD=0， SD=0时 a b 0 0 1 1 1 1 若a门快， =0，Q=1 若b门快， Q=0， =1 当RD=SD=0同时变为1时，翻转快的门输出变为0，另一个不得翻转。--------不定状态，应当避免。 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * 逻辑符号 SD RD 逻辑状态表 0 1 不变 不定 1 0 1 0 0 1 1 0 S D R D Qn+1 简化的逻辑状态表 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * 不定 Q R S 例：基本RS触发器的R、S端波形如下，画出Q端波形。 不定 Q Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * 由或非门组成的基本RS触发器 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * 0 1 不变 不定 S D R D Qn+1 1 0 1 0 0 1 1 0 Evaluation only. Created with Aspose.Slides for .NE