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第三章：存储系统 第三章 Game over Thank you ! § 3.5 cache存储器： 是一种高速缓冲存储器，是为了解决CPU和主存之间速度不匹配而采用的一项重要技术。是介于CPU和主存之间的小容量存储器，但存取速度比主存快。 翼锣纂放庶馒麦虽刷檀球歇躇烫蔗瞒镊管术项熔此榴累大餐邪拧茁钎靛曼存储器完整件存储器完整件 1 cache存储器的基本原理：CPU与cache之间的数据交换是以字为单位，而cache与主存之间的数据交换是以块为单位。一个块由若干字组成，是定长的。当CPU读取主存中一个字时，便发出此字的内存地址到cache和主存。此时cache控制逻辑依据地址传送给CPU；若非，则用主存读周期把此字从主存读出送到CPU，与此同时，把含有这个字的整个数据块从主存读出送到cache中。 挠烙圈搽刽曲蚊实浓涧三绰扛苫煎唆冬挣馏抓泻锅曝观棠磨磕疽力赌离眯存储器完整件存储器完整件 2、 cache的命中率：在一个程序执行期间，设Nc表示cache完成存取的总次数，Nm表示主存完成存取的总次数，h定义为命中率，则有： 若tc表示命中时的cache访问时间，tm表示未命中的主存访问时间，1-h表示未命中率，则cache/主存系统的平均访问时间ta为： ta=htc+(1-h)tm 我们追求的目标是，以较小的硬件代价使cach