反相器设计.docx

0.18umCMOS反相器的设计与仿真 2016311030103 吴昊 实验目的 在SMIC 0.18um CMOS mix-signal环境下设计一个反相器，使其tpHL=tpLH，并且tp越小越好。利用这个反相器驱动2pf电容，观察tp。以这个反相器为最小单元，驱动6pf电容，总延迟越小越好。制作版图，后仿真，提取参数。 实验原理 反相器特性 1、输出高低电平为VDD和GND,电压摆幅等于电源电压； 2、逻辑电平与器件尺寸无关； 3、稳态是总存在输出到电源或者地通路； 4、输入阻抗高； 5、稳态时电源和地没通路； 开关阈值电压Vm和噪声容限 Vm的值取决于kp/kn 所以P管和N管的宽长比值不同，Vm的值不同。增加P管宽度使Vm移向Vdd，增加N管宽度使Vm移向GND。当Vm=1/2Vdd时，得到最大噪声容限。 要使得噪声容限最大，PMOS部分的尺寸要比NMOS大，计算结果是3.5倍，实际设计中一般是2~2.5倍。 反向器传播延迟优化 1、使电容最小（负载电容、自载电容、连线电容） 漏端扩散区的面积应尽可能小 输入电容要考虑： （1）Cgs 随栅压而变化 （2）密勒效应 （3）自举电路 2、使