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- 2017-06-29 发布于安徽
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仿真中是利用modelsim软件的自带加载仿真数据功能实现的仿真。所以没有编仿真数据文件。数据流依次是(47
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
ENTITY frame IS
PORT (clk:IN STD_LOGIC;
data: IN STD_LOGIC_vector(0 to 7);
syna:OUT STD_LOGIC);
END frame;
ARCHITECTURE behavior OF frame IS
TYPE state IS(s0,s1,s2,s3,s4);
SIGNAL s,next_s:state; 记录状态
SIGNAL d:STD_LOGIC_vector(0 to 7); 描述数据流
SIGNAL num:INTEGER RANGE 0 TO 15; num用来找到祯头计数祯长的
SIGNAL evenorodd:STD_LOGIC; 记录是否找到祯
SIGN
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