流水线adc低功耗结构研究 research on the low power dissipation of pipeline adc.pdfVIP

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2017-08-12 发布于上海
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流水线adc低功耗结构研究 research on the low power dissipation of pipeline adc

集成电路设计与开发 ofIC Desi印锄d隗ve蛔皿elIt 流水线ADC低功耗结构研究李博1，李哲英2 摘要：介绍了一种50MHz，10位，5V流水线模数转换器的设计。为实现低功耗设计目标，将比较器和0TA作为主要优化对象，采用改进的动态比较结构和套筒式余量放大器(OTA)分别 mw。实现上述功能。本设计在0．5肚mCMOs工艺下实现，工作在50MHz条件下功耗为190 关键词：模数转换器；低功耗；流水线；套筒式余量放大器；动态比较器中图分类号：TN43文献标识码：A 文章编号：1003．353x(2007)02．0162．05 ResearchontheLowPower of ADC Di鲻ipationPipeline LIB01，u zhe．yin92 (1．scboZ 0，Ek￡ron泌E嚼r煳i昭，舛昭mm协，lg珈沁rs咖，＆讲增100044，吼i船； 2．删白m口#如n＆幻以，曰嘶昭功如n№妙，蚍100101，醌由m) Alow 10bit／50MHz ADC ％e Abstmct： power pipelinew鹬desi驴ed．improVeddynaIIliccompamtor aIld OTAwere toachievethe mldthemin for telescopic adopted desi印specification，iInproveInentsrealizing low ％e wim CMOS whichachieVeda powerdissipation．des咖iInplemented0．5弘m technology power of190mWat50MHz rate． dissipation sampling words： low Key ADC； powerdissipation；pipeline；telescopicO’11A；dynamiccoHlpar{nor 采用1．5位／级结构具有两个主要优点。首先， 1 引言各级增益为2，使得采样保持放大器获得最大带深亚微米下的短沟道和噪声温度等效应，使诸宽。其次，每级只需要2个比较器，且比较器失调如高线性度、高速、低功耗数据转换器(ADc)等在±吃f／．4内均可校正而不会影响ADc的线性度和信混合信号电路设计难度加大。作为模拟前端重要模噪比，此外大幅度的误差校正可缓解各级设计压力。块的模数转换器，需要工作在较低功耗下以满足嵌入便携式系统低耗能要求。此类模块广泛应用于手机、PDA、3G无线终端和WLAN中，因此需要对 ADc低功耗问题进行研究，并在电路层次提出解决方案。本文针对1．5位／级流水线模数转换器特有的电路拓扑做出分析，并对实现的设计进行功耗估算，提出低功耗设计思路和改进方案，给出对比结果。图1为典型流水线ADc结构，各级实现对输入的粗量化(子ADc)、量化结果的数模转换(子 DAc)、余量生成、余量放大等4个功能。两相非交叠时钟控制取样和保持操作在各级间协调进行，使每个时钟周期均产生量化输出值。