数字电子技术基础第04章.ppt

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数字电子技术基础第04章

2. 超前进位加法器 基本原理:加到第i位 的进位输入信号是两 个加数第i位以前各位 (0 ~ i-1)的函数, 可在相加前由A,B两数确定。 优点:快,每1位的和 及最后的进位基本同时产生。 缺点:电路复杂。 74LS283 由全加器真值表可以看出,有两种情况下会产生进位输出信号CO。 一是AB=1,二是A+B=1且CI=1。所以: C0为第0位的进位输出信号,为0,所以上式中仅含P和G,即第i位的 进位(CO)i和能由A和B唯一确定。 进位生成函数 进位传送函数 … … … … 三、用加法器设计组合电路 基本原理: 若函数可变换成输入变量与输入变量相加或输入变量与常量相加,则可用加法器进行设计 例:将BCD的8421码转换为余3码 输 入 输 出 D C B A Y3 Y2 Y1 Y0 0 0 0 0 0 0 1 1 0 0 0 1 0 1 0 0 0 0 1 0 0 1 0 1 0 0 1 1 0 1 1 0 0 1 0 0 0 1 1 1 0 1 0 1 1 0 0 0 0 1 1 0 1 0 0 1 0 1 1 1 1 0 1 0 1 0 0 0 1 0 1 1 1 0 0 1 1 1 0 0 加法器的其它应用 1.加法器级联实现多位二进制数加法运算 用2片74LS283组成的8位二进制数加法电路 2. 用74LS283实现码余3码到8421BCD的转换 思考:已知X是3位二进制数(其值小于等于5),试实现Y=3X 并用7段数码管进行显示 ? Y=3X ? D2 D1 D0 4.3.5 数值比较器 用来比较两个二进制数的数值大小 一、1位数值比较器 A,B比较有三种可能结果 二、多位数值比较器 原理:从高位比起,只有高位相等,才比较下一位。 例如: 2. 集成电路CC14585 实现4位二进制数的比较 3. 比较两个8位二进制数的大小 4.4 组合逻辑电路中的竞争-冒险现象 4.4.1 竞争-冒险现象及成因 一、什么是“竞争” 两个输入“同时向相反的逻辑电平变化”,称存在“竞争” 二、因“竞争”而可能在输出产 生尖峰脉冲的现象,称为 “竞争-冒险”。 三、2线—4线译码器中的竞争-冒险现象 4.4.2 * 略 4.4.3 消除竞争-冒险现象的方法 一、接入滤波电容 尖峰脉冲很窄,用很小的电容就可将尖峰削弱到 VTH 以下。 二、引入选通脉冲 取选通脉冲作用时间,在电路达到稳定之后,P的高电平期的输出信号不会出现尖峰。 三、修改逻辑设计 例: 4.5用multisim分析组合逻辑电路 例:用mulitisim分析逻辑电路.找出电路的逻辑函数式和逻辑真值表。 * * 3X=2X+X,将X接至B2B1B0,同时接至A3A2A1。 集成译码器实例:74HC138 低电平输出 附加 控制端 又称为最小项译码器 有3个附加控制端 只有当 、 同时为0 且 为1时芯片才能工作。 74HC138的功能表: 输 入 输 出 S1 A2 A1 A0 0 X X X X 1 1 1 1 1 1 1 1 X 1 X X X 1 1 1 1 1 1 1 1 1 0 0 0 0 1 1 1 1 1 1 1 0 1 0 0 0 1 1 1 1 1 1 1 0 1 1 0 0 1 0 1 1 1 1 1 0 1 1 1 0 0 1 1 1 1 1 1 0 1 1 1 1 0 1 0 0 1 1 1 0 1 1 1 1 1 0 1 0 1 1 1 0 1 1 1 1 1 1 0 1 1 0 1 0 1 1 1 1 1 1 1 0 1 1 1 0 1 1 1 1 1 1 1 译码器的扩展 例: 用74HC138(3线—8线译码器) 4线—16线译码器 D3=1 D3=0 二、二—十进制译码器 将输入BCD码的10个代码译成10个高、低电平的输出信号 BCD码以外的伪码,输出均无低电平信号产生 例:74HC42 三、显示译码器 按显示方式分,有字型重叠式、点阵式、分段式等。 按发光物质分,有半导体显示器,又称发光二极管(LED)显示器、荧光显示器、液

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