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基于CPLD的I2C总线接口设计.pdf

第 l9卷 第 2期 电子设计工程 2011年 1月 Vo1.19 No.2 ElectronicDesignEngineering Jan.2011 基亏CPLD的I2C总线接 口设计 郑采君 (中国地质科学院地球物理地球化学勘查研 究所 河北 廊坊 0650o0) 摘要 :在电路设计 中,VC总线是 比较常用的两线式 串行通信方式 ,大 多数 的CPU都擅长于并 口操作 ,不具备直接操 作 I2C总线接 口的能力 为 了使不具备 FC总线接 口能力的CPU通过对并 口的简单操作实现对 I℃ 总线接 口的控制 , 在分析 IzC总线常用工作模式 的基础上 ,设计 实现工作于主机模式 的,以CPLD完成 IzC总线开始信号 、结束信号的 输 出 以及并行数据到 IC总线模式 串行数据转换或 IzC模 式 串行数据 到并行 数据转换 的 I2C接 713模块 。采用该模块 , 可以使不具备 FC总线接 口的CPU通过并 口方便地控制 IzC总线设备 ,简化系统程序设计。 关键词 :I2C接 口;CPLD;VHDL;串行通信 中图分类号:TP216 文献标识码 :A 文章编号 :1674—6236(2011)02-0145-05 DesignofIzC businterfacebasedonCPLD ZHENGCai-jun ([nsthuteofGeophysicalandGeochemcialExplorationCAGSPRC,Langfang065000,China) Abstract:Inthecircuitdesign,FCisacommonusedandstandardserialcommunicationinterface.MostoftheCPU isgoodat parallelportoperation,anddon’thavetheabilityofoperating12Cbusinterfacedirectly.Inordertorealizethecontrollingof CPUtoVCinterface.onthebasisofanalysingfavoriteI2Cworkmode.thispaperdesignsbutimplementsaVCinterfacemodule whichcanbeworkedathostmode,exportedstartsignalandstopsingal,andchangedparalleldatatoVCserialdataorFC serialdatatoparalleldatabyCPLD.Withthismodule,CPUcancontroltheI2Cbusbysimpleparallelportoperation,which cansimplifythesystem programming. Keywords:IzC interface;CPLD;VHDL;serialcommunication I2C总线是两线式 串行总线 ,用于连接微控制器及其外 较常见的如:日历芯片、存储芯片、模数转换器 以及数模转换 围设备 。该总线具有如下特 点 :1)只要求两条总线线路 .一 器等 。 条串行数据线 (SDA),一条串行时钟线 (SDL);2)每个连接到 不幸的是大 多数 CPU都擅长操作并 口,而并不具备直接 总线的器件都可以通过唯一的地址寻址 ,总线 中主机可 以作 操作 I2C总线接 口的能力。在系统设计时,为 了与具有 I2c总 为主机发送器或主机接收器 ;3)它是一个真正的多主机总线 , 线接 口的芯片连接 ,经常采用 的方法是 :利用 CPU的2条通

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