简易数字秒表的设计.docVIP

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2018-03-08 发布于河南
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简易数字秒表的设计.doc

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简易数字秒表的设计

简易数字秒表的设计一、实验目的1、设计一个显示范围为24小时60分钟60秒的简易数字秒表。2、掌握动态扫描电路的设计方法。二、实验原理1、能进行正常的时、分、秒计时功能，分别由6个数码管显示24小时、60分钟、60秒钟的计数器显示。2、能利用实验系统上的按键实现“校时”“校分”功能：⑴按下“SA”键时，计时器迅速递增，并按24小时循环，计满23小时后回“00”；⑵按下“SB”键时，计分器迅速递增，并按59分钟循环，计满59分钟后回“00”，但不向“时”进位；⑶按下“SC”键时，秒清零；⑷要求按下“SA”、“SB”或“SC”时均不产生数字跳变（SA”、“SB”、“SC”按键是有抖动的，必须对其消除抖动处理）。3、能利用扬声器做整点报时：⑴当计时到达59分50秒时开始报时，在59分50秒、52秒、54秒、56秒、58秒鸣叫，鸣叫声频率可定为500Hz；⑵到达59分60秒时为最后一声整点报时，整点报时频率可定为1KHz。三、实验内容1、用VHDL语言编程设计简易数字秒表（VHDL程序代码可附在实验报告后面）。2、锁定引脚并下载验证结果。四、实验结果1、程序代码LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;USE IEEE.STD_LOGIC_UNSIGNED.ALL;ENTITY TIMES IS??PORT(CLK:IN STD_LOGIC; ?????? START,CLR:IN STD_LOGIC; ?????? DOUT:OUT STD_LOGIC_VECTOR(23 DOWNTO 0));END TIMES;ARCHITECTURE ART OF TIMES ISSIGNAL SECOND,MINUTES,HOURS:STD_LOGIC_VECTOR(7 DOWNTO 0);SIGNAL SEC_CO,MIN_CO,HOU_CO:STD_LOGIC;BEGIN-------------------------------------------------------秒计数处理进程??SEC:PROCESS(CLK,CLR)????BEGIN????IF CLR=1 THEN SECOND(7 DOWNTO 0)????ELSIF CLKEVENT AND CLK=1??THEN ??????IF START=1 THEN????????SECOND(3 DOWNTO 0)=SECOND(3 DOWNTO 0)+1;????????IF SECOND(3 DOWNTO 0)=1001 THEN ????????SECOND(3 DOWNTO 0)=0000;SECOND(7 DOWNTO 4)=SECOND(7 DOWNTO 4)+1;????????END IF;????????IF SECOND(7 DOWNTO 0)?THEN????????????SECOND(7 DOWNTO 0) SEC_CO=1;ELSE SEC_CO=0;????????END IF;?????? END IF; ????END IF;??END PROCESS SEC;--------------------------------------------------------分钟计数处理进程??MIN:PROCESS(SEC_CO,CLR)????BEGIN??????IF CLR=1 THEN MINUTES(7 DOWNTO 0)??????ELSIF??SEC_COEVENT AND SEC_CO=1 THEN????????MINUTES(3 DOWNTO 0)=MINUTES(3 DOWNTO 0)+1;????????IF MINUTES(3 DOWNTO 0)=1001 THEN ????MINUTES(3 DOWNTO 0)=0000;MINUTES(7 DOWNTO 4)=MINUTES(7 DOWNTO 4)+1;????????END IF;????????IF MINUTES(7 DOWNTO 0)THEN???????????????????????????? ??????????MINUTES(7 DOWNTO 0)MIN_CO=1;ELSE MIN_CO=0;????????END IF;??????END IF;??END PROCESS MIN;------------------------------------------