官方说明书ST 74V2T126 数据手册.pdfVIP

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官方说明书ST 74V2T126 数据手册.pdf

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官方说明书ST 74V2T126 数据手册

ST 74V2T126 handbook /file/2714070 From ManualL ManualL collects and classifies the global product instrunction manuals to help users access anytime and anywhere, helping users make better use of products. Home: / Chinese: / This Manual: /file/2714070 查询74V2T126供应商 74V2T126 DUAL BUS BUFFER (3-STATE) HIGH SPEED: tPD = 3.8ns (TYP.) at VCC = 5V LOW POWER DISSIPATION: ICC = 1µA(MAX.) at TA = 25°C COMPATIBLE WITH TTL OUTPUTS: VIH = 2V (MIN), VIL = 0.8V (MAX) POWER DOWN PROTECTION ON INPUTS SOT23-8L AND OUTPUTS SYMMETRICAL OUTPUT IMPEDANCE: |IOH| = IOL = 8mA (MIN) ORDER CODES BALANCED PROPAGATION DELAYS: tPLH ≅ tPHL PACKAGE T R OPERATING VOLTAGE RANGE: SOT23-8L 74V2T126STR VCC(OPR) = 4.5V to 5.5V IMPROVED LATCH-UP IMMUNITY Power down protection is provided on all inputs and outputs and 0 to 7V can be accepted on inputs with no regard to the supply voltage. This DESCRIPTION device can be used to interface 3V to 5V systems The 74V2T126 is an advanced high-speed CMOS and it is id