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官方说明书ST 74V2T86 数据手册.pdf

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官方说明书ST 74V2T86 数据手册

ST 74V2T86 handbook /file/2714214 From ManualL ManualL collects and classifies the global product instrunction manuals to help users access anytime and anywhere, helping users make better use of products. Home: / Chinese: / This Manual: /file/2714214 查询74V2T86供应商 74V2T86 DUAL 2-INPUT EXCLUSIVE OR GATE HIGH SPEED: tPD = 4.8ns (TYP.) at VCC = 5V LOW POWER DISSIPATION: ICC = 1µA(MAX.) at TA = 25°C COMPATIBLE WITH TTL OUTPUTS: VIH = 2V (MIN), VIL = 0.8V (MAX) POWER DOWN PROTECTION ON INPUTS SYMMETRICAL OUTPUT IMPEDANCE: SOT23-8L |IOH| = IOL = 8mA (MIN) at VCC = 4.5V BALANCED PROPAGATION DELAYS: tPLH ≅ tPHL ORDER CODES OPERATING VOLTAGE RANGE: PACKAGE T R VCC(OPR) = 4.5V to 5.5V SOT23-8L 74V2T86STR IMPROVED LATCH-UP IMMUNITY Power down protection is provided on all inputs DESCRIPTION and 0 to 7V can be accepted on inputs with no The 74V2T86 is an advanced high-speed CMOS regard to the supply voltage. This device can be DUAL 2-INPUT EXCLUSIVE OR GATE fabricated used to interface 5V to 3V. with sub-micron silicon gate and double-layer metal wiring C2MOS technology. PIN CONNECT