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计算机控制技术 * * 第二章 计算机控制器与接口技术 接口电路的含义 CPU 控制器接口（片内） 开关量接口I/O 模拟量接口A/DD/A 脉冲量接口C/T 通讯接口 传感器接口（片外） 幅值变换 电平变换 阻抗变换 信号整形 传感器 总线 专线 CPU和控制器接口的特点： 1.通过数字量传递信息（TTL电平信号）； 2.通过总线方式传递信号； 地址总线选择传递对象 A0~A15 数据总线传递数据内容 D0~D7 控制总线控制传递方式 3.同一时刻只能有一个控制器外设与CPU交换数据 控制器接口和传感器接口特点： 1.传递信号方式多样性； 2.信号的传递形式有一定的要求； 3.一般采用专线连接，可同时传递。 一.开关量输入和输出过程通道 （一）片内接口的一般方式 C P U 数 据 输 入 三 态 门 数 据 输 出 锁 存 器 地 址 译 码 器 数据总线 “读”线 选通线 “写”线 选通线 地址总线 数据总线 I0 I1 I2 I3 I4 I5 I6 I7 数据输入端口 P6 P5 P4 P3 P2 P1 P0 P7 数据输出端口 (01H) (02H) 1.CPU接口操作方式 执行数据输入指令（汇编指令）LD A,P1，转化为多个微操作： a.地址总线输出操作对象地址(P1)，通过译码器，形成操作对象选通信号； b.数据总线进入输入状态(LD)； c.在发出有效读信号后，通知对方输出数据，将数据总线内容存入CPU累加器(A); 执行数据输出指令（汇编指令）ST A,P2 ，转化成多个微操作： a.地址总线输出操作对象地址(P2)通过译码器生成操作对象选通信号； b.数据总线上送出(ST) 累加器A的数据。 c.在发出有效写信号后，通知对方接收数据。 2.数据输入三态门 Q D C 输入端D “读”选通C V+ 输出端Q Q为高阻态 D=X C=1 Q=0 D=0 C=0 Q=1 D=1 C=0 三态门的电路结构 三态门主要用于总线隔离。 在于CPU交换数据时，三态门开通； 不与CPU交换数据时，三态门输出处于高阻态，不影响其它外设使用总线。 б б б б б б б б б б 11 12 13 14 15 16 17 18 19 20 1 2 3 4 5 6 7 8 9 10 Vcc 1Y1 2A4 1Y2 2A3 1Y3 1Y4 2A2 2A1 1A1 2Y4 1A2 1A3 1A4 2Y1 2Y3 2Y2 GND 典型三态门LS244结构图： SN54LS244……J SN74LS244 ……J OR N (TOP VIEW) 3.数据锁存器 D CLK D Q GND V+ Q0 L × Q0 H × H L ↑ L L H ↑ H Q CLK D OUTPUT INPUT 由D触发器组成 锁存器的作用是将数据总线的数据锁存起来，在CLK有效时锁存器输出跟随总线输入。在CLK无效时，锁存器的输出与总线无关。 Q D CK CLEAR D Q CK CLEAR Q D CK CLEAR D Q CK CLEAR Q D CK CLEAR D Q CK CLEAR Q D CK CLEAR D Q CK CLEAR 2 6 5 4 3 7 8 9 10 1 19 15 16 17 18 14 13 12 11 20 CLR 1Q 1D 2D 2Q 3Q 3D 4D 4Q GND Vcc 8Q 8D 7D 7Q 6Q 6D 5D 5Q CLOCK SN54273,SN54LS273……J PACKAGE SN74273,SN74LS273……J OR N PACKAGE 锁存器LS273原理图 4.译码器 将地址总线信号转换成外设选通专线 以LS138三八译码器为例 SN54LS138,SN54S138……JOR W PACKAGE SN74LS138,SN74S138……JOR W PACKAGE (TOP VIEW) 5.片内I/O接口电路 地址译码方式： 1.选通线和 相或； 2.用译码器合成选通信号 (二)片外接口 1.开关量输入接口要求 输入端不可悬空 可闲置 闲置规定 Ri≤50KΩ Ri≤5KΩ 输入阻抗规定 低电平 0V≤Vi≤0.7V 低电平 0V≤Vi≤0.7V 高电平 3.6V≤Vi≤5V 高电平 2.4V≤Vi≤5V 电平规定 CMOS电平 TTL电平