数字电路仿真预备知识.docVIP

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  • 2018-05-26 发布于河南
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数字电路仿真预备知识

一、虚拟仪器的使用: 1、字信号发生器(Word Generator) 常用指示元件 Digital Probe Decoded Seven-Segment Display Seven-Segment Display 例3:利用字信号发生器驱动七段译码显示器。如图23所示。 解:图23所示为译码器74LS47逻辑功能的测试电路,其输入端与字信号发生器输出端相连,其输出端与七段数码管相连。通过设置字信号发生器的输出状态从0000H~000FH周期性的变化,观察数码管的显示状态,可以看到其显示从0~9,而000AH~000FH无显示,说明74LS47为一个8421BCD的译码 / 驱动电路。 2、逻辑分析仪(Logic Analyzer) 逻辑分析仪是数据域测量的重要仪器,它最多可以同步记录和观察16路逻辑信号波形,主要用于对数字信号的高速采集和时序分析,是示波器无法替代的专用逻辑功能测试仪器,也是分析和调试数字系统不可多得的重要工具。图24所示为逻辑分析仪的图标和面板图。 图标左侧16个端口是逻辑分析仪的输入信号端口,从上至下依次为最低位至最高位。 图标下部还有3个端子,C是外时钟输入端,Q是时钟控制输入端,T是触发控制输入端。 双击图标可以打开逻辑分析仪的面板,其操作如下: 被采集的多路信号以方波形式显示在显示区屏幕上,通过设置输入导线的颜色可以修改相应波形的颜色,这样可用颜色区分不同的多路信号。Stop是停止仿真按钮,单击它可以显示当前的波形;Reset是复位并清除显示波形按钮。 Clock区:包括Clock/Div栏Set按钮。 Clock/Div:设置在显示屏上单位水平刻度显示的时钟脉冲数。 Set按钮:设置时钟脉冲,单击该按钮后出现如图25所示的对话框。 其中,Clock Source区是时钟脉冲来源,如果选取External则设置成由外部取得时钟脉冲;如果选取Internal则设置成由内部取得时钟脉冲。Clock Rata区的功能是选取时钟脉冲的频率。Sampling Setting 区的功能是设置取样方式。 Trigger区:设置触发方式,点击Set按钮,出现如图26所示的对话框。 其中,Trigger Clock Edge 区的功能是设定触发方式,包括Positive(上升沿触发)、 Negative(下降沿触发)、Both(升、降沿触发均可)等3个选项。Trigger Patterns区的功能是设置触发样本,可以在PatternA、 PatternB及PatternC栏中设定触发样本,也可以在Trigger Combinations栏中选择组合的触发样本。当所有项目选定后,点击Accept按钮即可确定。 例4:用逻辑分析仪观察字信号发生器产生的时序逻辑信号。 解:按图27所示将字信号发生器的输出信号由低位至高位与逻辑分析仪的输入端对应连接。设置字信号发生器频率为1kHz,字信号输出范围为0000~000FH0000→0001→0010→0011→0100→0101→…→000E→000F,即为16进制关系。 3、逻辑转换仪(Logic Converter) 逻辑转换仪是Multisim 2001特有的虚拟仪器设备,实验室中并不存在这样的实际仪器。逻辑转换仪主要功能是很方便地完成真值表、逻辑表达式和逻辑电路三者之间的相互转换。逻辑转换仪的图标和面板如图29所示,图30所示是转换方式选择按钮的含义。 由电路转换为真值表的方法:首先画出逻辑电路图,将其输入端接至逻辑转换仪的输入端,输出端接至逻辑转换仪的输出端。然后按下“电路→真值表”按钮,在真值表区就会出现该电路的真值表。 由真值表转化为逻辑表达式:首先根据输入信号的个数用鼠标点击逻辑转换仪顶部代表输入端的小圆圈(由A至H),选定输入信号,此时在真值表区将自动出现输入变量的所有组合,而右面的输出列的初始值全部为“?”。然后根据所要求的逻辑关系确定真值表的输出值(0、1或X),方法是用鼠标多次点击真值表输出列中的输出值。最后点击“真值表→表达式”按钮,这时在面板底部逻辑表达式栏会出现相应的逻辑表达式。如果要得到简化的逻辑表达式,点击“真值表→简化表达式”按钮即可。注意表达式中用“’”表示逻辑变量的“非”运算。 此外,还可以直接在逻辑表达式栏中输入表达式(“与-或”式及“或-与”式均可),然后按下“表达式→电路”按钮可得到相应的真值表(注意:如果是逻辑“非”,例如则应写成;则应转换为,输入);按下“表达式→电路” 按钮可得到相应的逻辑电路;按下“表达式→与非电路”按钮可得到由与非门构成的电路。 练习:用逻辑转换仪将下列逻辑函数表达式转换成真值表和与非门电路。 (1) (2) (3) 二、数字电路仿真测试典型实例 1.组合逻辑电路的设计 组合逻辑电路的设计步骤一般为

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