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全国2010年7月自学考试计算机组成原理试题答案 一、 1-5、CDBDA 6-10、CCABC 11-15、ACACA 二、 16、中断嵌套是指中断系统正在执行一个中断服务时，有另一个优先级更高的中断提出中断请求，这时会暂时终止当前正在执行的级别较低的中断源的服务程序，去处理级别更高的中断源，待处理完毕，再返回到被中断了的中断服务程序继续执行，这个过程就是中断嵌套 17、微地址寄存器（μAR）：微程序控制器中的一个部件(寄存器),存放将要访问的下一条微指令的微地址。 18、寻址方式：对指令的地址码进行编码，以形成操作数在存储器中的地址的方式。 三、 19、 高速缓存（Cache）是一个高速小容量的临时存储器，它一般用高速的静态存储器芯片实现或者集成到CPU芯片内部，存储CPU最经常访问的指令或者操作数据。它主要是为了解决CPU运算速度与内存读写速度不匹配的矛盾，因为CPU运算速度要比内存读写速度快很多，这样会使CPU花费很长时间等待数据到来或把数据写入内存。系统工作时，将运行时要经常存取的一些数据从系统内存读取到Cache中，而CPU会首先到Cache中去读取或写入数据，如果Cache中没有所需数据（或Cache已满，无法再写入），则再对系统内存进行读写，另外Cache在空闲时也会与内存交换数据，起到缓冲作用，使CPU既可以以较快速度存取内存中的数据，提高系统整体性能，又不使系统成本上升过高。 20、 寄存器寻址和存储器间接寻址二种寻址方式。 存储单元地址为2000中的数据作为地址单元中的数据和寄存器R2中的数据相加，得到的和放入寄存器R2中。 21、 　（1）将机器指令分解为基本的微命令序列，用二进制代码表示这些微命令，并编成微指令，多条微指令再形成微程序。　（2）一条微指令包含的微命令，控制实现一步（一个节拍）操作；若干条微指令组成的一小段微程序解释执行一条机器指令。 22、 在多重中断系统中，CPU响应中断的步骤是： 1、关中断。暂时禁止所有中断响应。 2、保存现场信息，包括保存PC的值。 3、判别中断条件，根据中断优先级判断中断源，从而确定中断服务程序入口。 4、开中断。设置CPU优先级为当前中断的优先级，只允许响应优先级更高的中断。 5、执行中断服务程序。完成中断请求的操作，其间可能被更高级中断请求打断。 6、关中断。暂时禁止所有中断响应。 7、恢复现场信息，包括恢复PC的值。 8、开中断，继续执行原程序。 23、 同步通信是一种比特同步通信技术，要求发收双方具有同频同相的同步时钟信号，只需在传送报文的最前面附加特定的同步字符，使发收双方建立同步，此后便在同步时钟的控制下逐位发送/接收。 　　没有数据发送时，传输线处于MARK状态。为了表示数据传输的开始，发送方先发送一个或两个特殊字符，该字符称为同步字符。当发送方和接收方达到同步后，就可以一个字符接一个字符地发送一大块数据，而不再需要用起始位和停止位了，这样可以明显地提高数据的传输速率。采用同步方式传送数据时，在发送过程中，收发双方还必须用一个时钟进行协调，用于确定串行传输中每一位的位置。接收数据时，接收方可利用同步字符使内部时钟与发送方保持同步，然后将同步字符后面的数据逐位移入，并转换成并行格式，供CPU读取，直至收到结束符为止。 24、略 数据序列 1 0 1 1 0 NRZ1 PM FM 四、 25、 [3]补=0011 [-5] 补=1011 R0=0000 R1=1011 R2=0011 P=0 循环 步骤 乘积(R0 R1 P) 0 初始化 0000 1011 0 1 R0-R2 R0 1101 1011 0 R0R1右移1位 1110 1101 1 2 无操作 1110 1101 1 R0R1右移1位 1111 0110 1 3 R+R2 R0 0010 0110 1 R0R1右移1位 0001 0011 0 4 R0-R2 R0 1110 0011 0 R0R1右移1位 1111 0001 1 26、 PC-MAR PC+1-PC M-MDR，MDR-IR R3-C R1-MAR M-MDR，MDR-D C-A D-B A+B-R3 五、 27、 （1）、4片 （2）、15位，A14（高）~A0(低) （3）、13位，A12（高）~A0(低) （4）、A14~A13 全国2010年7月自学考试计算机组成原理试题 课程代码：02318 一、单项选择题(本大题共15小题，每小题2分，共30分) 在每小题列出的四个备选项中只有一个是符合题目要求的，请将其代码填写在题后的括号内。错选、多选或未选均无分。 1．若十进制数为115，则