数字电路与逻辑设计a卷.docx

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2020-08-14 发布于天津
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试卷编号命题人王玉青审核人试卷分类卷或卷五邑大学试卷学期至学年度第学期课程数字电路与逻辑设计课程代号使用班级信息工程学院级姓名学号题号一二三四五六七八九总分得分得分一填空题分每空分时序逻辑电路按照其触发器是否由统一的时钟控制分为时序逻辑电路和时序逻辑电路当数据选择器的数据输入端的个数为时其地址代码应有位两个位二进制数字和相比较可以用作为的输出信号寻址容量为的需要根地址线欲设计一个进制的计数器至少需要片触发器的特性方程为当与非门的输入端悬空时相当于输入接入电平模数转换器两个最重要的指标是转换精度和

试卷编号 1 1 Illi' 1 1 1 n 1 1 1 1 1 1 1 4 1 1 1 ? 1 I I I 1 1 命题人：王玉青审核人：试卷分类（A卷或B 卷）「五邑大学试卷学期： 2013 至 2014 学年度第_J 学期课程：数字电路与逻辑设计课程代号： 0700280 使用班级：信息工程学院 2011级姓名：学号：题号 ——一二三四五六七八九总分得分得分一、填空题（15分，每空1分） 1?时序逻辑电路按照其触发器是否由统一的时钟控制分为时序逻辑电路和时序逻辑电路。当数据选择器的数据输入端的个数为 8时，其地址代码