VHDL实现走马灯的程序.docVIP

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2020-08-21 发布于浙江
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VHDL实现走马灯的程序.doc

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LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; ENTITY light IS PORT( cp,co: IN STD_LOGIC; finalout: OUT STD_LOGIC_VECTOR(7 DOWNTO 0)); END light; ARCHITECTURE arch OF light IS TYPE all_state IS (S0,S1,S2,S3,S4); SIGNAL state: all_state; SIGNAL a: STD_LOGIC; SIGNAL lightout:STD_LOGIC_VECTOR(7 DOWNTO 0); SIGNAL clk: STD_LOGIC; SIGNAL clk_tmp: STD_LOGIC; signal cnt : integer range 0 to BEGIN process(cp) begin if (cpevent and cp=1) then if cntthen cnt=0; clk_tmp= not clk_tmp; else cnt=cnt+1; end if; end if; end process; clk=clk_tmp; PROCESS(clk,co) BEGIN IF(clkevent and clk=1 and co=0) THEN CASE lightout IS WHENlightout WHENlightout WHENlightout WHENlightout WHENlightout WHENlightout WHENlightout WHENlightout WHEN OTHERS=lightout END CASE; ELSIF(clkevent and clk=1 and co=1) THEN CASE state IS WHEN S0=state=S1; lightout a=0; WHEN S1= IF(a=0) THEN state=S2; lightout ELSIF(a=1) THEN state=S0; lightout END IF; WHEN S2= IF(a=0) THEN state=S3; lightout ELSIF(a=1) THEN state=S1; lightout END IF; WHEN S3= IF(a=0) THEN state=S4; lightout ELSIF(a=1) THEN state=S2; lightout END IF; WHEN S4=state=S3; lightout a=1; END CASE; END IF; END PROCESS; finalout=lightout; END arch;