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电路综合实验实验报告
一.最长线性反馈移存器序列生成器
1?设计流程
本部分是设计如下图所示的模块
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elk
dout
dout为已转变为2bit的输出
m_ge n
clear在clear
clear
在clear为1的时候清零
IF tmp(0)=0 THEN dout=01;
ELSE dout=11;
END IF; temp=tmp;
END PROCESS p1;
将输出的tmp ( 0)1bit的结果利 用if语句赋给2位的vector形式 的 dout,实现 2bit输出, 0— 01,1 — 11。
temp将temp输出有两个目的:
temp (0)为未转变的1bit输出
在部分测试时,在波形中一目 了然
设计大致流程
p1:PROCESS(clk)
BEGIN
IF(clkeve nt and clk=1) THEN
IF clear=1 THEN tmp=0000;
ELSE
IF tmp=0000 THEN tmp=0001;
ELSE
tmp(3)=tmp(0) xor tmp(3); tmp(2)=tmp(3);
tmp(1)=tmp(2);
tmp(0)=tmp(1);
将最高位最低位异或结果传入 最高位,除最低位外其余三位 依次向后移一位,随后将最低 位输出,实现m序列。
END IF;
END IF;
END IF;
2?设计思路:
在时钟的上升沿作用时执行以下操作
在clear为1时执行tmp赋值为0000;否则对tmp执行以下操作
b)将除了最低位的其余三位依次向后挪一位
在tmp为0时,将dout赋值为01 ;否则,将dout赋值为11
将tmp赋给temp输出。
实验仿真结果及分析
quartusii 运行结果:
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(2) modelsim测试文件代码以及仿真结果:
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(3 )分 析: 可 以 从 图 中 看 出 形成 的 序 列是
以 ” 0001^1000 — 1100— 1110— 1111—0111 — 1011 — 0101 — 1010 — 1101 — 0110
—0011 — 1001 — 0100 — 0010 — 0001 为周期,即15个数字(2的4次方减1)为周期 的M序列。Dout则是根据4位的最后一位决定的,将 1转化成11,0转化成01。
4?实验中遇到的问题及解决方法:
相对于整个项目,这个部分容易一些,所以在编写过程中没有遇到太大的问题
(1)在第一次编写仿真时发现波形在每次变化时波动较大, 在15次变化,即一个周期结束
进入下一周期时会出现一段时间的乱码, 刨除quartusii选择的板子本身带来的不精确外, 虽
调整了 clear
调整了 clear和elk
波形图对比:
未调整的quartus
JJ/E3 TEI2H □ be.ZEE □ d_eZC 口
JJ/E3 TE
I2H □ be.
ZEE □ d_e
ZC 口 u
ZED □ c-e
eL**t
调整后的quartusii
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调整后的modelsim
(2 )第一次用modelsim软件进行仿真,对其测试文件的编写可以说是从零开始, 虽然并不 是很难,但是有一些细节必
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