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学 海 无 涯
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基于FPGA的Verilog HDL数字钟设计
专业班级 姓 名 学 号
一、实验目的
1.掌握可编程逻辑器件的应用开发技术?——设计输入、编译、仿真和器件编程；
2.熟悉一种EDA软件使用；
3.掌握Verilog设计方法；?
4.掌握分模块分层次的设计方法；?
5.用Verilog完成一个多功能数字钟设计;?
6.学会FPGA的仿真。
二、实验要求
功能要求：
利用实验板设计实现一个能显示时分秒的多功能电子钟，基本功能：
准确计时，以数字形式显示时、分、秒，可通过按键选择当前显示时间范围模式；
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