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本实用新型公开是关于一种基于FGPA实现PDM解码的装置,涉及PDM解码技术领域。FPGA集成电路设置有数据输入口,数据输入口输出端连接有CIC抽值滤波器,CIC抽值滤波器输出端串联设置有两个半带抽取滤波器,第二个半带抽取滤波器输出端设置有FIR低通滤波器,FIR低通滤波器输出端连接有PC端;FPGA集成电路固定于壳体内,壳体内还设置有时钟方向选择器和电平转换器,电平转换器输出端与时钟方向选择器连接,时钟方向选择器输出端与FPGA集成电路连接。本实用新型通过在FPGA内部实现PDM信号并变成PC
(19)中华人民共和国国家知识产权局
(12)实用新型专利
(10)授权公告号 CN 213751958 U
(45)授权公告日 2021.07.20
(21)申请号 202022510529.1
(22)申请日 2020.11.03
(73)专利权人 深圳市谙声科技有限公司
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