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本发明提供了一种用于卷积神经网络的内存计算eDRAM加速器,其特征在于,包括四个P2ARAM块,每个P2ARAM块包括由64x16个5T1C乒乓eDRAM位单元组成的5T1C乒乓eDRAM位单元阵列,在每个P2ARAM块中,由64X2个数字时间转换器从行方向将4比特激活值转换成不同的脉冲宽度,并输入到5T1C乒乓eDRAM位单元阵列中进行计算;而在5T1C乒乓eDRAM位单元阵列的列方向共得到16X2个卷积结果输出。本发明提出的卷积神经加速器使用了:5T1C乒乓eDRAM位单元并行多比特存储和卷
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113946310 A
(43)申请公布日 2022.01.18
(21)申请号 202111169936.3
(22)申请日 2021.10.08
(71)申请人 上海科技大学
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