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本发明提供了一种基于FPGA的并行异构数据库加速方法，包括获取待计算原始数据；host启动DMA将待计算原始数据搬运至FPGA加速器的缓存DDR中；FPGA加速器对所述数据进行读取与存储，判断是否有可写Ram；若没有则中断FPGA，则返回并继续获取待计算原始数据；若有则FPGA加速器内启动DDR读操作，将数据取出并写入本地任一Ram中；写满任一Ram后，启动数据解析以及计算，计算完成后Ram位置为可写状态，记录DDR读地址；判断是否完成所有数据计算，若是，则结束；若不是，则返回步骤103数据全部
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114443616 A
(43)申请公布日 2022.05.06
(21)申请号 202111667493.0
(22)申请日 2021.12.30
(71)申请人 苏州浪潮智能科技有限公司
地址 2
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