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本发明公开了一种应用在闪存控制器中的编码电路,其包括有一辅助数据产生电路以及编码器。在所述编码电路的操作中,所述辅助数据产生电路是用以接收多个数据组块以产生所述多个数据组块的辅助数据,且所述编码器是根据一校验码检查矩阵来对所述多个数据组块进行编码以产生校验码,并使用所述辅助数据来替换所述校验码中的一部分以产生调整后校验码,其中所述多个数据组块以及所述调整后校验码是被写入至闪存中。本发明通过将编码电路原本所产生的校验码中的相依位替换为具有实际功用的辅助数据,以充分利用存储器空间来避免浪费空间,此外
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114694739 A
(43)申请公布日 2022.07.01
(21)申请号 202210210238.1 H03M 13/11 (2006.01)
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