用于实现基4 Booth乘法器的64位加法器及其实现方法、运算电路及芯片.pdfVIP

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2023-05-16 发布于四川
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用于实现基4 Booth乘法器的64位加法器及其实现方法、运算电路及芯片.pdf

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本申请实施例提供了一种用于实现基4Booth乘法器的64位加法器及其实现方法、运算电路和芯片，该加法器包括：用于确定16组带有基4Booth乘法进位权重的32比特的部分积在第0‑63个比特位上对应的比特位，并对第0‑63个比特位上的部分积分别进行压缩，输出64比特的2组数据；带进位链的进位加法器，包括：N个进位模块，每个进位模块对应64比特的2组数据的多个比特位，每个进位模块的预处理单元，用于对对应的64比特的2组数据中的多个比特位进行预处理；进位计算单元，用于生成第n个进位模块对应的每个比特位

(19)国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 114756200 A (43)申请公布日 2022.07.15 (21)申请号 202210402682.3 (22)申请日 2022.04.18 (66)本国优先权数据 202210343263.7