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本发明涉及嵌入式系统通信技术领域，具体公开了一种基于FPGA的SRIO多通道控制方法，其中，包括：获取N个发送通道的发送数据，每个发送通道的接口时序均为预设通道接口时序，每个发送通道的发送数据均存储在于发送通道对应的存储器中；将N个发送通道的发送数据进行优先级顺序处理，得到按照优先级顺序排列的待发送信息；将待发送信息依次通过SRIOIP的发送接口发出；获取SRIOIP的接收接口的接收数据，并对接收数据进行解析以确定对应的接收通道；将解析后的接收数据写入与接收通道对应的存储器。本发明还公开了一
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114900588 A
(43)申请公布日 2022.08.12
(21)申请号 202210443475.2
(22)申请日 2022.04.26
(71)申请人 无锡华普微电子有限公司
地址 21
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