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- 2023-05-25 发布于四川
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在特定方面中,一种数字电路包括延迟线以生成输入时钟的多个延迟版本。数字电路还包括:选择电路装置,基于时钟选择信号提供输入时钟的多个延迟版本中的所选一个延迟版本;以及反馈电路装置,基于输入时钟的多个延迟版本中的所选一个延迟版本以及基于输入时钟生成时钟选择信号。时钟选择信号进一步用于选择和生成其他时钟和/或用于变化控制。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 110199478 A
(43)申请公布日
2019.09.03
(21)申请号 20178
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