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本发明公开了一种高速逐次逼近型模数转换电路及DAC权重分配方法，所述电路包括比较器、数模转换器和逐次逼近逻辑电路；所述比较器的正相输入端连接第一数模转换电容阵列的输出，反相输入端连接第二数模转换电容阵列的输出，复位输入端与异步时钟产生电路输出端连接，比较器输出比较结果、锁存就绪信号和比较时钟；所述逐次逼近逻辑电路的时钟输入端连接时钟信号，比较结果输入端连接比较器的比较结果输出，锁存就绪信号输入端连接比较器的锁存就绪信号输出；逐次逼近逻辑电路输出数字编码与数模转换器连接。所述方法包括以下步骤：1.
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 111277270 A
(43)申请公布日
2020.06.12
(21)申请号 20201
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