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本发明属于集成电路设计领域，提供一种参考时钟丢失检测电路，其包括：交流耦合电容，分频器，电压‑电流‑电压转换，比较器和输出缓冲器，其中，交流耦合电容隔除参考时钟的直流信号，分频器整理参考时钟的占空比并调整参考时钟的信号幅度，分频后的信号经过电压电流转换器，可以区分跳变的时钟信号和不跳变的逻辑低信号，比较器和输出缓冲器输出参考时钟状态信号，当待检测的参考时钟正常、丢失及其它异常时，输出一个信号来表征参考时钟的状态，以此实现对参考时钟状态的检测。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112305413 A
(43)申请公布日
2021.02.02
(21)申请号 20191
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