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本发明公开了一种算法步长及环路带宽自适应调整的小数全数字锁相环，该小数全数字锁相环包括鉴频鉴相器、时间数字转换器、第一减法器、第二减法器、第一加法器、第一寄存器、第一乘法器、自适应步长/带宽控制算法模块、LMS算法模块、数字环路滤波器、数控振荡器、多模分频器以及ΣΔ调制器。本发明对现有的电路结构进行了改进，并对电路模块进行了性能优化和结构创新。本发明的自适应步长/带宽控制算法根据锁相环的状态来同时调整LMS算法收敛步长以及锁相环的带宽，从而实现了LMS算法收敛时间短、小数杂散性能好、锁相环锁定时
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 115833829 A
(43)申请公布日 2023.03.21
(21)申请号 202211536319.7
(22)申请日 2022.12.01
(71)申请人 南京邮电大学
地址 210023
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