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本文揭示了用于小数重对准的锁相回路电路。回馈除法器基于控制振荡器频率产生回馈除法时钟信号。Δ‑Σ调变器耦合到该回馈除法器，并产生除法比给该回馈除法器。累积相位调节器耦合到该Δ‑Σ调变器，并且(i)判断频率调谐字与除法比之间的差值，以及(ii)产生粗调谐字和细调谐字。数字时间转换器耦合到该累积相位调节器，并且基于参考时钟频率、粗调谐字和细调谐字来产生第一时钟频率。重对准脉冲产生器耦合到该数字时间转换器并且基于第一时钟频率来产生重对准时钟，该第一时钟频率的周期与控制振荡器频率的周期相同。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112532235 A
(43)申请公布日
2021.03.19
(21)申请号 20201
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