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本申请公开了一种运算加速器,该运算加速器包括：第一缓存，用于存储第一输入数据；第二缓存，用于存储权重数据；与该输入缓存和该权重缓存连接的运算电路，用于对第一输入数据和该权重数据进行矩阵乘运算以得到计算结果；压缩模块，用于对该计算结果进行压缩以得到压缩数据；与该压缩模块连接的直接存储器访问控制器DMAC，用于将该压缩数据存入到该运算加速器之外的存储器。由于在该运算加速器中增加了压缩模块，降低了从该运算加速器中搬运计算结果到存储器的数据量，节省该运算加速器的I/O带宽，提升该运算加速器的计算性能。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112771546 A
(43)申请公布日 2021.05.07
(21)申请号 201880098124.4
(22)申请日 2018.09.30
(85)PCT国际申
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