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一种延迟可配置的异步FIFO电路.pdfVIP

一种延迟可配置的异步FIFO电路.pdf

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    本发明公开一种延迟可配置的异步FIFO电路，属于集成电路领域，包含整数延迟和小数延迟。由数字上变频的插值倍数决定FIFO小数延迟的最大允许值，由FIFO存储单元数量决定FIFO整数延迟的最大允许值。根据与读时钟同频，且相位之间固定偏移为DAC时钟周期的采样时钟作为标尺，判断读写时钟相位关系，来获取FIFO小数延迟，其最小单位为输入数据周期除以插值比。通过比较读写指针之间的状态差，来获取FIFO整数延迟，其最小单位为写时钟周期。在此基础上，对FIFO的延迟进行配置以达到目标时序余量。本发明中可设置

    (19)中华人民共和国国家知识产权局 (12)发明专利 (10)授权公告号 CN 113110821 B (45)授权公告日 2022.02.01 (21)申请号 202110420079.3 (51)Int.Cl.

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