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- 2023-06-15 发布于四川
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本发明公开了一种用于LDPC译码器的高效交织器及交织方法，该交织器利用FPGA中的分布式RAM作为主要实现资源，通过读写地址控制和存储结构的设计，完成了传统结构中需要采用Benes网络完成的p个节点换序读出，处理后再原序回写的功能，在满足TDMP的LDPC译码器工作要求的同时，兼顾了资源与吞吐率需求。与传统的交织器相比，本发明的交织器在保证读写效率的前提下大幅降低了资源消耗，提高了FPGA的资源利用率。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113206674 A
(43)申请公布日 2021.08.03
(21)申请号 202110385774.0
(22)申请日 2021.04.11
(71)申请人 南京理工大学
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