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本发明公开了一种基于Verilog减法运算的CPLD平台除法实现方法，包括如下步骤：CPLD寄存器接收并转换无刷电机转速信息数据，二进制保存以得到二进制的转速信息结果；将转速信息结果进行二分法的减法算法，并将二分法减法算法转换为二进制除法运算；利用移位方式在CPLD逻辑芯片中，实现PI控制算法中的乘除积分运算，实现CPLD平台的除法算法形成除法器。本发明在CPLD平台上，通过二分法的减法转换方式实现除法运算，进而实现在CPLD平台的无刷直流电机的PI控制，其CPLD为逻辑芯片能进行PI的乘、除、
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113765458 A
(43)申请公布日 2021.12.07
(21)申请号 202110888440.5
(22)申请日 2021.08.03
(71)申请人 贵阳航空电机有限公司
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